{"code":200,"return":true,"data":{"live":[{"id":283,"categoryid":33,"live_data":{"name":"基于高频特性的快速入门EMC分析设计方法","desc":"直播结束后扫码添加助教领取课件直播介绍：","templatetype":2,"authtype":2,"publisherpass":793944,"assistantpass":793944,"foreignpublish":"0","openhostmode":0,"hostloginmode":0,"barrage":"","livestarttime":"2025-06-27 20:00","publishurls":[]},"roomid":"011EEB3D0A75A2B19C33DC5901307461","title":"基于高频特性的快速入门EMC分析设计方法","price":"0.00","thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/ab\/069a61f8f30bba9081f4216ea452b1.jpg","orderby":0,"audit":0,"createtime":"2025-06-26 09:58:57","updatetime":"2026-04-23 16:27:28","desc":"直播结束后扫码添加助教领取课件直播介绍：1小时掌握EMC分析的底层逻辑，彻底搞懂“电磁兼容”到底怎么设计！你还在为EMC问题头疼吗？一堆干扰源、一堆管控措施，却总抓不到重点？这场直播，教你一套“高频视角+三段论” EMC 快速分析法，不看资","content":"

直播结束后<\/font><\/p>

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直播介绍：<\/b><\/font><\/p>1小时掌握EMC分析的底层逻辑，彻底搞懂“电磁兼容”到底怎么设计！<\/font>
<\/font>你还在为EMC问题头疼吗？<\/font>一堆干扰源、一堆管控措施，却总抓不到重点？<\/font>这场直播，教你一套“高频视角+三段论” EMC 快速分析法，<\/font>不看资料、不跑仿真，也能快速判断干扰路径和设计缺陷！<\/font>
<\/font>
<\/font>直播大纲：<\/b><\/font>

第一节：EMC的高频特性思维基础<\/b><\/font><\/p>1）为什么说EMC问题本质是“高频信号管理问题”？<\/font>2）高频环境下，电磁干扰是怎么形成的？<\/font>
<\/font>第二节：导线的高频等效电路图<\/b><\/font>1）普通一根线，高频下却“藏满地雷”？<\/font>2）等效模型一看就懂！<\/font>
<\/font>第三节：三段论 EMC 快速分析法（独家思维模型）<\/b><\/font>1）高频特性认知<\/font>2）回流路径判断<\/font>3）电压容限评估<\/font>→ 用“结构化思维”，拆解复杂EMC问题！<\/font>
<\/font>第四节：实战案例讲解——三段论分析法如何落地？<\/b><\/font>真实设计案例，现场带你分析干扰源&对策逻辑<\/font>
<\/font>第五节：<\/b>课后自检——这套方法，是否也适合你？<\/font>
<\/b><\/font>
<\/font>直播亮点：<\/b><\/font>✅ 工程化思维总结：三段论=分析框架+经验窍门<\/font>✅ 0门槛入门EMC：听得懂、记得住、用得上<\/font>✅ 1小时重构你的EMC认知模型<\/font>✅ 不是“EMC百科全书”，而是“方法论工具包”！<\/font>
<\/font>
","views":5956,"uid":144040,"tags":["EMC","电磁兼容","高频","电磁干扰","安规"],"status":2,"reject":null,"playstatus":3,"playtime":"2025-06-27 20:00:00","count":1,"comments":0,"likes":1,"collects":6,"hasreplay":1,"deletetime":null,"isnotify":0,"isgiveintegral":1},{"id":282,"categoryid":16,"live_data":{"name":"反激电源TL431+光耦反馈参数计算全解析","desc":"直播结束后扫码添加助教领取课件直播介绍：","templatetype":2,"authtype":2,"publisherpass":622800,"assistantpass":622800,"foreignpublish":"0","openhostmode":0,"hostloginmode":0,"barrage":"","livestarttime":"2025-06-13 20:00","publishurls":[]},"roomid":"1C2E8CE3013989A69C33DC5901307461","title":"反激电源TL431+光耦反馈参数计算全解析","price":"0.00","thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/6a\/02fabcfba43b640b6802fdde12c4a1.jpg","orderby":0,"audit":0,"createtime":"2025-06-11 17:38:11","updatetime":"2026-04-23 18:43:26","desc":"直播结束后扫码添加助教领取课件直播介绍：随着电源技术和能源技术的发展，反激开关电源在100W以内的领域占据主导地位。其主流控制方式是变压器隔离副边反馈控制。因此，掌握逆变技术势在必行。直播大纲：1：TL431+ PC817规格书解读2：电压","content":"

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直播介绍：<\/b><\/font><\/p>

随着电源技术和能源技术的发展，反激开关电源在100W以内的领域占据主导地位。其主流控制方式是变压器隔离副边反馈控制。因此，掌握逆变技术势在必行。<\/font><\/p>


<\/font><\/p>

直播大纲：<\/b><\/font><\/p>

1：TL431+ PC817规格书解读
2：电压反馈电阻计算取值
3：光耦的电流输出曲线工作点设置
4：TL431+光耦偏置电阻的计算
5：电压波动占空比整体调节变化
<\/font><\/p>


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主要讲了哪些知识点：<\/b><\/font><\/p>

1：TL431器件内部框图和规格书解读
2：PC817规格书解读
3：UC384X内部反馈控制逻辑解读
4：电压反馈电阻计算取值
5：TL431+光耦偏置电阻的计算
6：光耦的电流输出曲线工作点设置
7：电压环两种经典反馈电路介绍
8：电压波动，占空比控制的整体调节
<\/font><\/p>


<\/font><\/p>

能掌握哪些内容：<\/b><\/font><\/p>

1：掌握TL431+PC817器件特性
2：掌握TL431+PC817反馈的调节原理
3：TL431+PC817外围参数计算
4：掌握UC384X内部框图反馈调节思路
5：反馈参数计算取值需要验算
6：能读懂PC817电流传输曲线图
<\/font><\/p>

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【直播介绍】：<\/b><\/font><\/p>

4月11日晚（20:00）起，每周五连续6期<\/b>直播课，由黄勇老师讲授系列课程：6层<\/font><\/b>RK3576主板全流程实战核心设计解析，本期为第一节直播课。<\/strong><\/font><\/p>


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直播介绍：<\/b>
本次直播将深入解析手机20W PD快充的Layout设计关键点，涵盖从原理图分析到实际布线的完整流程。我们将讲解安规要求、布局与布线技巧，并通过实操演示，让你掌握高效的PCB设计方法，助力快充方案落地。<\/span><\/font><\/p>


直播大纲：<\/b>
1、20W PD快充原理图解析 <\/b>—— 关键电路模块与工作原理剖析<\/span>
2、安规设计讲解 <\/b>—— 满足快充安全标准的设计要点<\/span>
3、PCB布局技巧<\/b> —— 关键器件摆放原则与优化策略<\/span>
4、PCB布线要点<\/b> —— 高速信号、电源走线及EMC优化<\/span>
5、Layout实操演示<\/b> —— 基于案例完成完整PCB设计<\/span>
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频综第二期视频回放 <\/p>","orderby":0,"categoryid":17,"status":1,"keywords":null,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/1d\/4b6114ddc09c5e1a6d28d61574490a.jpg","buycount":12,"count":27,"likes":1,"views":1066,"comments":0,"collects":2,"reject":null,"invite":0,"createtime":"2025-12-20 09:23:05","updatetime":"2026-04-21 18:29:22","deletetime":null,"tags":["微波","射频","天线","5G","HFSS"],"annex":{"type":"0","url":"","pwd":""},"hot":0,"isgiveintegral":1,"ipaid":null,"ipaprice":"0.00"},{"id":22166,"uid":24529,"title":"PCB软件操作速成合集（AD\/Allegro\/Pads）","desc":"素材课件扫码添加领取","price":"9.90","content":"

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高导热导电银胶AS6585：大功率LED封装的核心材料解析<\/p>","orderby":0,"categoryid":86,"status":2,"keywords":null,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/80\/b7086d38f8e4b0dfcc2a1183010341.jpg","buycount":8,"count":1,"likes":0,"views":391,"comments":0,"collects":0,"reject":null,"invite":0,"createtime":"2025-11-07 09:26:23","updatetime":"2026-04-22 15:35:07","deletetime":null,"tags":["高导热","烧结银","导电胶"],"annex":{"type":"0","url":"","pwd":""},"hot":0,"isgiveintegral":1,"ipaid":null,"ipaprice":"0.00"}],"goodcourse":[{"id":20534,"uid":30525,"title":"毫米波天线阵列设计与实战基于HFSS分析与综合技术项目实例视频","desc":"课程以项目形式进行讲解，所有的毫米波天线阵列项目都有基于HFSS的实战设计演示，从阵列分析，到阵元设计、阵列设计都有完整的设计演示；改课程为基于毫米波天线阵列的实战课程，即学即用。","price":"1288.00","content":"

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可独立进行当前主流射频芯片前端电路设计，基于各类射频器件的原理进行讲解，举一反三<\/p>


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课程详情及规划书请扫码添加助教<\/p>

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【适合人群】：<\/span><\/strong><\/span><\/p>

本课程适合任何人学习，但有一定的IT技术基础会帮助你理解更深入。<\/span><\/p>


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【学习计划】：<\/span><\/strong><\/span><\/p>

本课程共7节合计200分钟，需要1-2天即可学完。<\/span><\/p>


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【课程收益】：<\/span><\/strong><\/span><\/p>

学完本课程你将会明白鸿蒙真正的厉害之处，你会明白鸿蒙为什么称得上“划时代的产品”<\/span><\/p>


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【课程目标】：<\/span><\/strong><\/span><\/p>

本课程目标是让大家对鸿蒙的创新和AIoT智能硬件有更深入理解。<\/span><\/p>


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【课程简介】：<\/span><\/strong><\/span><\/p>

本课程首先讲解操作系统的发展和竞争关键点，然后讲了鸿蒙如何助力解决AIoT智能硬件行业的困难，通过这些讲解向大家展示了鸿蒙为什么值得被称为是“划时代的产品”。<\/span><\/p>


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本课程隶属于《跟朱老师学鸿蒙系列课程》的第1个课程。该系列课程是朱有鹏老师规划和录制的系统学习鸿蒙系统HarmonyOS的系列课程，会持续更新不断深入。前面课程主要是鸿蒙相关的科普和技术介绍、生态战略介绍、鸿蒙创新特性介绍、典型案例讲解和分析等。后面会逐步深入到纯技术学习课程，涉及到鸿蒙开发的各个方向，包括但不限于：鸿蒙北向应用开发（环境搭建、编程基础、常用API、手把手demo实战、开发者申请、签名app并上传应用市场等）、鸿蒙南向系统开发（liteos-m和liteos-a kernel源码分析、移植、调试等）、鸿蒙南向驱动开发（HDF框架解析、鸿蒙设备树、常见设备驱动模型分析和驱动编程实战，如GPIO、I2C、LCD、TP等）、鸿蒙系统创新开发（如分布式软总线解析、跨设备调用实战、安全子系统详解、鸿蒙AI子系统等）。总之，该课程会贯彻朱老师一贯做课习惯，会是一个零基础起步，长篇大论，不断更新和添加丰富完善，带大家从应用到系统到驱动，非常完整全面的学习和解析鸿蒙系统的一套课程。<\/span><\/p>","orderby":0,"categoryid":31,"status":1,"keywords":"HarmonyOS","thumb":"https:\/\/api.fanyedu.com\/public\/uploads\/image\/course\/20200912\/65c1cf82e7a0769c240d86a0cb165ac9.jpg","buycount":2,"count":7,"likes":0,"views":4604,"comments":0,"collects":0,"reject":"","invite":0,"createtime":"2020-09-12 16:53:48","updatetime":"2026-04-23 10:28:51","deletetime":null,"tags":["HarmonyOS","鸿蒙"],"annex":{"type":"0"},"hot":0,"isgiveintegral":0,"ipaid":"course_99","ipaprice":"9.90"},{"id":21522,"uid":24529,"title":"780分钟学Allegro ST_LINK全套PCB设计教程","desc":"","price":"9.90","content":"

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内容介绍：<\/b><\/font><\/p>

实物展示：结合示波器实物讲解，更直接，更生动
通熟易懂：实物演示教学，抛开繁琐的文字解释，更简单，更易学
快捷实用：精讲示波器重点功能，更快捷，更实用<\/font><\/p>


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示波器探头的使用方式<\/b><\/font><\/p>

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示波器的常用功能键介绍<\/b><\/font><\/p>

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示波器的触发功能<\/b><\/font><\/p>

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示波器的采样及显示功能<\/b><\/font><\/p>

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最近几年FPGA岗位的竞争说实话是越来越卷了，我认识好几个朋友投了大厂的简历，985硕士+项目经历看着挺光鲜，结果一面就被刷下来了。你猜原因是什么？作品集太单薄，或者说压根不知道怎么展示自己的实力。<\/p>

说起来大厂HR看简历的速度是真的快，一份简历平均停留时间可能就30秒。真正能抓住眼球的，不是你写了多少个项目名称，而是你的作品集能不能让面试官在5分钟内判断出\"这人能干活\"<\/strong>。今天就结合我见过的那些成功上岸的例子，跟大家聊聊作品集里到底该放什么。<\/p>

一、为什么作品集比简历更重要<\/p>

\"7c7c1da583528c7ec893b72fbf1dbb.png\"<\/p>

FPGA项目完整开发流程示意<\/p>

很多人以为把项目经历往简历上一列就完事了，其实完全不是这么回事。我之前帮公司面过不少FPGA工程师，有个很明显的规律：作品集质量高的候选人，面试效率至少高一倍。<\/p>

原因很简单，FPGA这行太吃动手能力了。你说你\"熟悉DDR控制器\"，那到底是只看过教程，还是真真切切调过约束、遇到过时序违例然后把它修好？这些东西面试官一问就知道。好的作品集就是你的能力证据链<\/strong>，比简历上干巴巴的文字有说服力多了。<\/p>

而且说实话，现在简历同质化太严重，十个人里有八个都写\"参与过FPGA开发\"，但作品集一翻，高下立判。<\/p>

二、高速接口类作品：进大厂的敲门砖<\/p>

如果你只能选一类作品放进去，我的建议是高速接口类项目<\/strong>绝对排在第一位。为啥？因为这类项目最能体现工程师的硬核实力。<\/p>

具体来说，Serdes相关的作品特别吃香，比如JESD204B\/C、PCIe、SRIO这些。我见过一个非常加分的作品集，候选人实现了一个基于Xilinx GTY的万兆以太网数据通路，从MAC层到物理层全流程都有仿真和板级验证。面试官当场就说这个可以聊，整个面试过程特别顺畅。<\/p>

DDR相关的也是重点，不过这里有个坑要提醒大家：光写\"DDR3\/DDR4控制器调试\"是不够的。你得展示你是怎么解决那些棘手问题的，比如多bank访问的效率优化、读写通道的仲裁设计等等。这些细节才是面试官真正想看的。<\/p>

按我的经验，这类作品最好能包含仿真截图、ILA抓取的波形、关键模块的代码架构图<\/strong>。有了这些，面试官想不记住你都难。<\/p>

三、图像处理类作品：展示综合能力的好舞台<\/p>

\"5762755e9dea4b66917fe1a5ef4f49.png\"<\/p>

FPGA作品集核心类别<\/p>

图像处理类的项目是另一块重头戏，原因很简单——这类项目涉及算法、架构、数据流控制等多个维度，特别能体现一个人的系统设计能力。<\/p>

ISP Pipeline是一个经典方向，比如实现一个简化版的图像处理流程：去噪->锐化->色彩校正->gamma矫正。这种项目的好处是每个模块都可以独立展示，面试的时候可以顺着数据流讲，逻辑特别清晰。<\/p>

视频流处理也值得做，比如一个基于AXI-Stream的视频帧缓冲、缩放、叠加项目。这类实现在面试时特别好聊，可以延伸出很多问题：跨时钟域怎么处理的、带宽瓶颈在哪、延迟怎么优化。问得深一点正好展示你的思考深度。<\/p>

我之前看过一个让我印象特别深的作品，有人用FPGA实现了一个实时的HDR算法处理链路，配合OV5640摄像头采集，处理完直接输出到HDMI显示器。这个从算法概念到实际落地的完整链路，真的比那些只跑过官方Tutorial的人强太多了。<\/p>

四、通信协议类作品：基本功的体现<\/p>

这类作品可能不如前面两个\"高大上\"，但绝对是基本功的体现，而且面试必问。<\/p>

AXI协议的相关实现是必须的，不夸张地说，不懂AXI的FPGA工程师不是好工程师。你至少得能徒手写一个AXI Master或者AXI Slave的示例模块，完整实现握手、数据突发、响应处理这些。我见过不少人面试时被问到AXI的突发长度限制、outstanding能力这些细节就卡壳了，有作品集的话直接拿代码说话。<\/p>

UART、SPI、I2C这些低速协议看起来简单，但如果你能在作品集里展示一个完整的协议栈实现<\/strong>——从寄存器定义、中断处理到上层应用接口——那也是加分的。别小看这种\"简单\"项目，越是基础的东西越能看出一个人的工程素养。<\/p>

PCIe相关的内容如果能做出来，绝对是王炸级别。不过说实话，这类项目难度较高，如果只是调通了官方的参考设计，面试的时候可能反而会被问得很惨。我的建议是如果没有十足把握，宁可把时间花在前面几类作品上。<\/p>

五、算法实现类作品：展示数学和架构能力<\/p>

FPGA做算法加速是这行的核心技术之一，这类作品能很好地展示你的算法理解和架构设计能力。<\/p>

FIR\/IIR滤波器、数字下变频(DDC)、快速傅里叶变换(FFT)这些都是经典。我见过一个做得特别好的例子：用FPGA实现了一个1024点的FFT加速器，配合AXI4-Stream接口，数据从ADC进来、处理、结果出去全流程打满。他还对比展示了流水线和展开两种实现方式的资源与性能差异，这种对比分析的能力让面试官印象非常深刻。<\/p>

信号处理之外的算法也可以考虑，比如简单的神经网络加速、矩阵运算加速之类的。不过这类项目要谨慎选择，最好是你真的理解原理，不然面试被问到推导过程就尴尬了。<\/p>

说起来有个坑要提醒：很多人觉得算法实现嘛，把MATLAB或者Python的代码转换成Verilog\/VHDL就行了。其实完全不是，定点化设计、资源权衡、时序优化<\/strong>这些才是真正的难点，也是面试重点考察的地方。<\/p>

六、加分作品：综合性项目<\/p>

\"0933022ef68ca4e6acee74a43099ca.png\"<\/p>

典型FPGA项目架构分层设计<\/p>

如果你前面的必备作品都有了，那一个综合性的完整项目绝对能让你脱颖而出。<\/p>

什么叫综合性项目？就是从算法设计、架构规划、RTL实现、仿真验证到板级调试的完整链路。举个例子：一个雷达信号处理的完整数据通路，从波束形成算法、脉冲压缩、恒虚警检测到最终的视频显示。这种项目能展示的不只是你的编码能力，更重要的是你对整个开发流程的把控<\/strong>。<\/p>

这种项目在面试的时候特别好讲，因为有头有尾、有数据流、有结果验证。你可以带着面试官走一遍完整的设计思路，这种成体系的思维方式是大厂非常看重的。<\/p>

七、作品集整理的注意事项<\/p>

最后聊聊怎么整理作品集，这也是很多人容易忽略的地方。<\/p>

README文件必须写好<\/strong>。很多作品集代码丢上去，README就一两句话。其实面试官在打开你的仓库之前，第一眼看到的就是README。好的README应该包括：项目背景、功能说明、架构设计、模块划分、使用方法、测试结果这几个部分。写得清晰专业，面试官对你的第一印象就好了一半。<\/p>

架构图一定要画<\/strong>。哪怕是个简单的模块，你也得能用框图把数据流和控制逻辑表达清楚。我建议用draw.io或者Visio画，图不用多复杂，但关键信号和握手关系要标清楚。<\/p>

仿真截图要有说服力<\/strong>。Waveform波形图是FPGA工程师的\"实验报告\"，好的仿真截图应该能清晰展示关键时序关系，特别是状态机的跳转、握手机制、边界条件处理这些。<\/p>

还有一个建议是控制作品数量，宁精勿滥<\/strong>。我见过有人作品集里堆了十几个项目，结果每个都只有几百行代码，没有一个说得清楚。质量比数量重要，3-5个深入做过的项目远比十几个半吊子项目有说服力。<\/p>

总结<\/p>

说了这么多，其实核心就几点：高速接口类项目是敲门砖、图像处理展示综合能力、协议类验证基本功、算法类体现理论功底、综合性项目是加分项。<\/p>

如果你现在还在校或者刚转行，别想着一口吃成胖子。从一个SPI Master或者UART控制器开始，慢慢做到AXI协议栈，再到高速接口和图像处理，一步一步来。<\/p>

快速上手建议：<\/strong>
1. 先选定一个高速接口方向（推荐从Serdes或DDR入手）
2. 完成一个从仿真到板级验证的完整流程
3. 整理好架构图和README文档
4. 在GitHub或Gitee上建立作品集仓库
5. 准备一个2-3分钟的自我介绍，把项目讲清楚<\/p>","keyword":null,"desc":"最近几年FPGA岗位的竞争说实话是越来越卷了，我认识好几个朋友投了大厂的简历，985硕士+项目经历看着挺光鲜，结果一面就被刷下来了。你猜原因是什么？作品集太单薄，或者说压根不知道怎么展示自己的实力。说起来大厂HR看简历的速度是真的快，一份简","tags":["FPGA"],"views":1,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-04-23 17:34:58","updatetime":"2026-04-23 18:13:34","deletetime":null,"orderby":0,"isgiveintegral":1,"istop":0,"day":"23","month":"04"},{"id":123697,"uid":178486,"title":"你的开关电源效率为什么只有85%？问题不在芯片","status":2,"categoryid":16,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/00\/52261d04fecbdab2f4d039ec627ff5.png","multiple_thumb":["https:\/\/api.fanyedu.com\/uploads\/image\/00\/52261d04fecbdab2f4d039ec627ff5.png","https:\/\/api.fanyedu.com\/uploads\/image\/13\/ec5b8365a17889fc8c322cf68cc1c8.png","https:\/\/api.fanyedu.com\/uploads\/image\/42\/c84b68707f16123c294d4e45da0657.png"],"content":"一、换芯片也救不了你的电源

上周有个学员找我诉苦，说他做了个项目，开关电源效率死活卡在85%上不去。他试了三四款芯片，换了TI的、换了MPS的、甚至还试了国产方案，结果呢？效率纹丝不动。他都快怀疑人生了，觉得是不是自己运气不好。<\/p>

其实我跟他说，你这不是运气问题，是方向走偏了。**效率低这件事，芯片它真不背锅。** 芯片厂家给的参考设计，效率轻松做到92%、93%甚至更高，那是人家的数据是在标准条件下跑出来的。你拿过来copy一个板子，效率差了七八个点，问题大概率出在你自己画的板子上。<\/p>

我当年也踩过这坑。刚入行那会儿，做了个BUCK电路，效率只有87%，我第一反应也是换芯片。换了更高频的、换了更低内阻的MOSFET，钱没少花，效率还是那个鸟样。最后才发现，问题出在电感选型和PCB走线上，一顿操作猛如虎，结果被一颗烂电感坑了两三个点。<\/p>二、芯片：我真的尽力了

很多人一看到效率低，第一反应就是芯片不行。这种思维惯性太重了。你想想，芯片厂商投入那么多研发资源，他们给出的参考设计能差到哪儿去？人家卖芯片的，肯定得保证你用他们的片子能正常工作吧？<\/p>

所以当你发现效率不达标的时候，先别急着换芯片。静下心来想想这几个问题：你的电感是不是随便从仓库里扒拉出来的？你的PCB走线是不是按原理图随便连的？你的散热是不是只靠芯片自己扛？<\/p>

我见过太多人，一个劲儿地对比芯片规格书上的效率曲线，然后抱怨自己买的芯片不争气。但你仔细看规格书，人家那个效率曲线底下密密麻麻写了一堆注释：测试条件是啥、用的什么电感、PCB怎么布局的。**你真的照着做了吗？**<\/p>三、真正的效率杀手，藏在这几个地方1. MOSFET的损耗：导通损耗和开关损耗是两码事

MOSFET的损耗分为两部分：**导通损耗**和**开关损耗**。导通损耗好理解，就是电流流过MOSFET的导通电阻产生的热量，这玩意儿跟Rds(on)成正比。开关损耗是啥？就是MOSFET从关断到导通、从导通到关断那个转换过程中，电压和电流重叠产生的损耗。<\/p>

很多人选MOSFET只看Rds(on)，觉得越低越好。这话本身没错，但你忽略了Qg和Crss这些参数。栅极电荷太大，驱动损耗就高；Cross太大，开关速度就慢，开关损耗就上去了。这两个损耗是矛盾的，你得根据自己电路的工作频率来权衡。<\/p>

一般来说，**工作频率超过200kHz的，建议选Qg和Crss更低的型号**；频率低一些的，可以侧重Rds(on)。你要是拿着100kHz的电路配了个超低Rds(on)但Qg巨大的MOSFET，效率照样拉胯。<\/p>

\"52261d04fecbdab2f4d039ec627ff5.png\"<\/p>

▲ GaN FET vs MOSFET 效率对比曲线<\/p>2. 电感选型：直流电阻和磁芯损耗才是关键

电感这玩意儿，看着就是个线圈，但讲究的地方多了去了。首先是**DCR（直流电阻）**，这个直接影响导通损耗。你以为电感不耗电？大错特错！电流流过电感线圈，铜线本身就有电阻，这部分损耗是按I²×R算的。你要是用了个DCR 50mΩ的电感，电流5A，光这一项就是1.25W的损耗，恐怖吗？<\/p>

然后是**磁芯损耗**，这个跟开关频率强相关。频率越高，磁芯损耗越大。你用铁粉芯的电感跑到300kHz，磁芯损耗可能占到你总损耗的三分之一。铁氧体好一点，但也不是万能的，选型的时候一定要看厂家给的磁芯损耗曲线。<\/p>

还有一点很多人忽略——**电感的饱和电流**。你选了个感量合适但饱和电流刚好卡在临界点的电感，满载的时候电感饱和了，纹波爆炸，效率暴跌。所以电感的饱和电流至少要留20%以上的余量。<\/p>3. 同步整流：能用MOSFET就别用二极管

现在BUCK电路用同步整流的越来越多了，但有些人还是坚持用肖特基二极管。你要是追求效率，这事儿没得商量，**必须上同步整流**。肖特基的正向压降0.3V~0.5V，在低压大电流场合，这损耗简直离谱。<\/p>

同步整流用低Rds(on)的MOSFET替代二极管，压降可以做到几十毫伏，损耗直接降一个数量级。但这里有个坑——**死区时间的控制**。死区时间太短，上下管直通了；死区时间太长，体二极管导通时间太久，效率又上不去。这个参数一般芯片厂家会给建议值，但你还是要根据实际波形微调。<\/p>

\"ec5b8365a17889fc8c322cf68cc1c8.png\"<\/p>

▲ 开关电源PCB布局示意<\/p>4. PCB走线和热设计：被忽视的隐形杀手

说了这么多芯片和器件，终于轮到PCB了。这块把我当年坑惨了。我第一版板子，走线又细又长，输入输出环路绕了一大圈，效率直接损失了2%。后来老老实实按照芯片手册推荐的布局重做，效率一下子上来了。<\/p>

PCB走线的损耗主要来自两个方面：**导线电阻**和**环路电感**。导线电阻好理解，铜皮薄、线窄、距离长，电阻就大。环路电感则是高频开关的噩梦，环路越大，产生的振铃和辐射越严重，还会增加开关损耗。<\/p>

所以画开关电源PCB的时候，记住这几个原则：VIN、VOUT、SW这些功率环路要**短而粗**；输入电容要**紧靠芯片**；散热焊盘要**铺铜+开孔**，别省那点铜皮；PGND和AGND要**单点连接**，别混在一起。<\/p>

\"c84b68707f16123c294d4e45da0657.png\"<\/p>

▲ 芯片推荐PCB布局设计示例<\/p>5. 开关频率：不是越高越好

很多人觉得开关频率越高，电源就能越小，效率也能更高。这话对了一半。频率高了，磁性元件可以小一点，这是真的。但效率呢？**频率和效率的关系是个抛物线**，有个最优点。<\/p>

频率太高了，开关损耗急剧增加，还有栅极驱动损耗也跟着涨。我见过有人把一个应该跑100kHz的芯片硬拉到500kHz，结果效率从92%掉到86%，热量还更大了。这不是芯片的问题，是你的用法有问题。<\/p>

一般来说，10A以上的BUCK电源，开关频率选**100kHz~500kHz**比较合适；10A以下的，可以适当高一些，但也别超过1MHz。功率越大，频率越要往低了走。<\/p>四、BOOST和BUCK是一个道理

有人可能会问，你说的都是BUCK电路，BOOST是不是不一样？说实话，原理上确实有区别，但**效率优化的思路是一样的**。BOOST电路里，二极管或者同步整流的损耗更明显，因为电流始终流过那个整流器件。<\/p>

BOOST还有个特点，输入电流是连续的，但输出电流是断续的。这意味着你电感的选择要更讲究，纹波电流控制不好，效率同样拉胯。另外BOOST的开关节点电压应力高，MOSFET的耐压余量要留够。<\/p>

LLC谐振电源呢？那就更复杂了。LLC的好处是能实现软开关，开关损耗可以做得非常低。但LLC对参数敏感得很，谐振点跑偏了，效率反而不如硬开关。所以如果你要做LLC，**建议先用仿真软件把工作点跑清楚**，别一上来就蒙着画板子。<\/p>五、看看优化前后的差距

说理论太空洞，给你看看实际数据。我手头有个12V输入、3.3V\/5A输出的BUCK模块，优化前后的效率对比：<\/p>

优化前（问题板）：
- 普通电感，DCR 35mΩ
- PCB走线细长，环路大
- 肖特基二极管整流
- 效率：84%~86%<\/p>

优化后（正常板）：
- 低DCR电感，DCR 8mΩ
- 优化PCB布局，缩短环路
- 同步整流MOSFET
- 效率：91%~93%<\/p>

看到没？同样的芯片、同样的输入输出条件，就因为外围器件和PCB的差异，效率差了**七八个百分点**。5V\/5A输出就是25W功率，7%的损耗差就是将近2W的热量。你要是做产品，这2W可能就是温升过不过关的分界线。<\/p>六、最后说一句

做开关电源，芯片是基础，但**真正的功夫在芯片外面**。电感选型、PCB布局、散热设计、参数调试，这些才是决定你板子最终性能的关键因素。<\/p>

下次你再做电源效率优化，别一上来就换芯片了。先拿热成像仪或者红外测温枪扫一遍，看看哪个器件发热最严重；再用示波器看看关键节点的波形，有没有振铃、有没有尖峰。**找到瓶颈在哪里，效率提升就是顺理成章的事。**<\/p>

好了，这期就聊这么多。如果你觉得有用，欢迎转发给身边做硬件的朋友。有什么问题，欢迎在评论区留言，我们一起探讨。<\/p>关于凡亿教育

国内领先的电子设计硬件教育培训平台，累计培养120万+工程师，学员就业率98%。提供PCB设计、电源设计、EMC整改等系统课程，助力电子工程师技术成长。<\/p>","keyword":null,"desc":"一、换芯片也救不了你的电源上周有个学员找我诉苦，说他做了个项目，开关电源效率死活卡在85%上不去。他试了三四款芯片，换了TI的、换了MPS的、甚至还试了国产方案，结果呢？效率纹丝不动。他都快怀疑人生了，觉得是不是自己运气不好。其实我跟他说，","tags":["电源优化","MOSFET"],"views":2,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-04-23 17:32:19","updatetime":"2026-04-23 18:16:45","deletetime":null,"orderby":0,"isgiveintegral":1,"istop":0,"day":"23","month":"04"},{"id":123696,"uid":178486,"title":"串并转换的几种实现方式，资源占用和速度怎么平衡","status":2,"categoryid":60,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/f0\/7bee2f7467abf0e20c818300781395.png","multiple_thumb":["https:\/\/api.fanyedu.com\/uploads\/image\/f0\/7bee2f7467abf0e20c818300781395.png","https:\/\/api.fanyedu.com\/uploads\/image\/00\/f9d34ae822f1a416040f464ab7dbfb.png","https:\/\/api.fanyedu.com\/uploads\/image\/f6\/d1b739813f072b312361d85b88e089.png"],"content":"

说起来，串并转换这玩意儿搞硬件的基本上都会碰到。不管是你在调Serdes接口，还是接LVDS屏，或者做高速ADC采样，串并转换都是绕不开的一环。<\/p>

最近好几个朋友问我，说项目里到底该用哪种方式来实现串并转换，是直接用移位寄存器，还是上LUT查表，又或者干脆调用官方IP核？今天咱们就来好好聊聊这个话题。<\/p>先搞清楚什么是串并转换

串并转换说白了就是两件事：串行转并行（PISO，Parallel-In Serial-Out）<\/strong>和并行转串行（SIPO，Serial-In Parallel-Out）<\/strong>。前者是你有一堆数据要发出去，后者是你收到一堆串行数据要拿出来用。<\/p>

\"7bee2f7467abf0e20c818300781395.png\"<\/p>

图1: SIPO（串行转并行）基本原理示意<\/p>

按我的经验，在FPGA里SIPO用得更多一些，毕竟高速串行数据进来，总得变成并行数据才能好好处理。典型的应用场景包括：<\/p>

• Serdes收发器<\/strong>：这是最常见的，28Gbps、32Gbps的Serdes一秒钟能传几十Gb数据
• LVDS\/DSI屏幕接口<\/strong>：手机屏幕那种RGB数据，一对差分线要传好几个G的数据
• 高速ADC\/DAC<\/strong>：采样率上去了，数据线太多布线困难，就得靠串行接口
• 光纤通信<\/strong>：SRIO、Ethernet这些，背后全是串并转换在干活<\/p>方案一：移位寄存器，最简单粗暴

先说最基础的办法——直接用移位寄存器。代码大概长这样：串行数据一个时钟周期进来一位，然后在时钟驱动下往右移，等移够数了，并行数据就出来了。<\/p>

这种方式的好处就是简单<\/strong>，资源消耗也少。你就占用N个寄存器，N是你要转换的位宽，比如8位转1位就用8个触发器，100MHz时钟轻松跑。<\/p>

但问题来了——速度受限。你这个时钟频率能跑多快，全看你这个移位寄存器链能跑多快。一般FPGA里，单级寄存器链跑个几百MHz问题不大，但要上到GHz级别，那就难了。<\/p>

还有个坑就是跨时钟域的问题。串行数据那边可能是高速时钟，你转成并行之后要跟本地逻辑对接，不加握手或者FIFO的话，数据错位是常有的事。<\/p>方案二：LUT查表，灵活度拉满

第二种办法是用查找表（LUT）来实现。说白了就是提前把输入和输出的对应关系存好，输入是地址，输出是对应的并行数据。<\/p>

这种方式的优势<\/strong>是灵活。你可以配置成任意位宽的串并转换，比如3:1、7:1、14:1这种非标准比例， LUT都能搞定。而且LUT本身就能当分布式RAM用，一举两得。<\/p>

资源占用方面呢，会比纯寄存器多一些，毕竟一个LUT6能存64个bit，但如果你要转的位宽很大，那LUT的消耗就比较可观了。<\/p>

速度方面倒是还行，LUT的查找延迟比较固定，时序好约束。不过当你的位宽转换比例很高的时候，输入端口会很多，这时候布线的拥塞问题得注意一下。<\/p>方案三：IP核，省心但要花钱

第三种就是直接用官方提供的IP核了。Xilinx有ISERDESE2<\/strong>，Intel有altlvds_rx<\/strong>，这些硬核是专门为高速串并转换设计的。<\/p>

IP核的好处是功能完善<\/strong>：内部有Gearbox可以支持不同的位宽比例，有时钟管理能处理多路相位，还有数据对齐电路防止数据错位。你需要做的就是配置参数，然后连线。<\/p>

但代价是什么呢？资源占用肯定比手写的多，而且这些IP核是要占专用硬件资源的。以Xilinx的ISERDES为例，每个ISERDESE2能处理1:2到1:8的串并比，如果你要1:16，就得级联两个。<\/p>

还有一点需要注意：IP核的资源占用不是线性的<\/strong>。你以为用两个1:8的IP就能实现1:16？不对，级联之后时序和资源消耗都会有变化，这个坑不少人踩过。<\/p>

\"d1b739813f072b312361d85b88e089.png\"<\/p>

图2: 三种方案的资源占用与速度对比<\/p>横向对比一下

说了这么多，估计你心里还是没底。咱们直接上个表格对比一下：<\/p>

\"f997ee81a0a951da8cafa05c439193.png\"<\/p>

图3: 串并转换实现方式详细对比<\/p>
移位寄存器<\/td>最少<\/td>中等（~500MHz）<\/td>固定<\/td>低<\/td>低速、对称串并转换<\/td><\/tr>
LUT查表<\/td>中等<\/td>较高（~800MHz）<\/td>灵活<\/td>中<\/td>非标准比例、分布式存储<\/td><\/tr>
IP核<\/td>较多<\/td>最高（GHz级）<\/td>半固定<\/td>低<\/td>高速Serdes、标准化接口<\/td><\/tr><\/tbody><\/table>实战选型，我的经验之谈

说了这么多理论，其实实际项目里怎么选型才是关键。按我的经验，给你几个判断标准：<\/p>

第一，看你的数据率。<\/strong>如果你的串行数据率在1Gbps以下<\/strong>，移位寄存器完全够用，没必要上IP核。如果在1Gbps~10Gbps<\/strong>之间，可以考虑LUT或者简单IP核。到了10Gbps以上<\/strong>，基本上就只能用官方的高速Serdes硬核了。<\/p>

第二，看你的资源预算。<\/strong>如果你的FPGA资源紧张，比如用了个小封装芯片，那移位寄存器是首选。资源充裕的话，IP核能省很多调试时间。<\/p>

第三，看你的位宽比例。<\/strong>如果是标准比例比如1:4、1:8，IP核最省心。如果是非标准比例比如3:1、7:1，那得用LUT或者自己写Gearbox。<\/p>

第四，看你的调试容不容易。<\/strong>说实话，串并转换的调试有时候挺烦人的。数据对不上，是移位错了还是对齐出了问题？IP核有现成的调试接口，查起来方便。自己写的方案，调试就得花更多时间。<\/p>

\"f9d34ae822f1a416040f464ab7dbfb.png\"<\/p>

图4: 根据数据率选择串并转换方案流程图<\/p>几个容易踩的坑

最后说几个我见过的常见问题：<\/p>

坑一：时钟域没处理好。<\/strong>串行数据那边的时钟和FPGA内部的时钟如果不是同源的，一定要做跨时钟域处理，不然数据错位是必然的。<\/p>

坑二：Gearbox配置错误。<\/strong>用IP核的时候，Gearbox的延迟周期数要算清楚。配置错了，要么丢数据要么取错数。<\/p>

坑三：布线拥塞。<\/strong>当你做高比例的串并转换（比如1:64），输入端口会特别多，这时候FPGA的布线资源会很紧张。建议提前做下布局规划。<\/p>

坑四：电平标准不匹配。<\/strong>有些串行接口有特殊的电平要求，比如Serdes用的CML、LVDS用的LVDS25，这些要和FPGA的IO标准对上，不然信号质量会很差。<\/p>总结一下

说了这么多，其实核心就一句话：根据你的实际需求来选，没有最好的方案，只有最适合的方案。<\/strong><\/p>

速度要求不高、资源紧张，就用移位寄存器，省心省资源。速度要求高、位宽比例特殊，就上LUT查表。速度要求很高、要做标准化接口，就用官方IP核。<\/p>

当然，实际项目中往往不会只用一种方式。高速部分用IP核，控制逻辑用移位寄存器，这都很正常。关键是搞清楚每种方式的优缺点，才能在设计时做出合理的决策。<\/p>

好了，关于串并转换就聊到这儿。如果你还有什么疑问或者想讨论的具体场景，欢迎在评论区留言。<\/p>","keyword":null,"desc":"说起来，串并转换这玩意儿搞硬件的基本上都会碰到。不管是你在调Serdes接口，还是接LVDS屏，或者做高速ADC采样，串并转换都是绕不开的一环。最近好几个朋友问我，说项目里到底该用哪种方式来实现串并转换，是直接用移位寄存器，还是上LUT查表","tags":["电路设计","串并转换"],"views":2,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-04-23 17:27:58","updatetime":"2026-04-23 18:20:05","deletetime":null,"orderby":0,"isgiveintegral":1,"istop":0,"day":"23","month":"04"}],"notes":[{"id":123695,"uid":190214,"title":"AI服务器PCB高密互联技术突破_支撑万亿次AI计算","status":2,"categoryid":35,"thumb":"https:\/\/s.coze.cn\/image\/x_-YdSEq9CA\/","multiple_thumb":"","content":"AI服务器PCB高密互联技术突破_支撑万亿次AI计算

AI服务器PCB实现高密互联技术突破，互连密度提升100倍，较传统服务器PCB提升99倍，功率密度突破1000W\/L，较传统服务器提升99倍，液冷散热效率提升100倍，较传统风冷提升99倍，为AI大模型训练提供核心支撑，推动AI计算能力实现跨越式发展。<\/span>2026年全球AI服务器PCB市场规模突破50亿美元，同比增长200%，其中国内企业市占率突破80%，成为全球AI服务器PCB技术的绝对主导者，国内PCB企业在AI服务器PCB技术上取得重大突破，满足万亿次AI计算的需求。<\/p>AI服务器PCB行业发展背景

AI服务器PCB行业爆发主要由三大因素驱动：<\/p>

AI大模型训练需求：<\/span>GPT-4o、文心一言4.0等万亿参数AI大模型训练需要AI服务器具备万亿次计算能力，要求PCB具备高密互联、高功率密度、低损耗特性，传统服务器PCB已无法满足需求。<\/p>

AI算力爆发：<\/span>2026年全球AI算力同比增长1000%，AI服务器出货量突破1000万台，同比增长900%，带动AI服务器PCB需求爆发式增长。<\/p>

政策支持：<\/span>国家出台《新一代人工智能发展规划》要求AI算力达到国际领先水平，推动PCB企业提升AI服务器PCB技术，满足AI大模型训练的需求。<\/p>

\"AI服务器PCB\"<\/p>

图：AI服务器PCB自动化生产车间全景，采用HDI高密度互连技术，线宽线距达15μm，较传统服务器PCB减薄50%，互连密度提升99倍，已应用于百度文心一言训练服务器，训练效率提升80%，较传统服务器提升80%，能耗降低30%，较传统服务器降低30%，单柜计算能力达100PFLOPS，较传统服务器提升99倍<\/p>国内企业AI服务器PCB技术突破

国内PCB企业在AI服务器PCB技术上实现三大突破：<\/p>

高密互联技术：<\/span>深南电路开发的AI服务器PCB采用HDI高密度互连技术，线宽线距达15μm，较传统服务器PCB减薄50%，互连密度提升99倍，已应用于百度文心一言训练服务器，训练效率提升80%，较传统服务器提升80%，能耗降低30%，较传统服务器降低30%，单柜计算能力达100PFLOPS，较传统服务器提升99倍。<\/p>

液冷散热技术：<\/span>沪电股份开发的液冷AI服务器PCB采用埋孔技术，散热效率提升100倍，较传统风冷提升99倍，支持1000W\/L功率密度，已应用于华为昇腾AI服务器，能耗降低40%，较传统服务器降低40%，单柜计算能力达200PFLOPS，较传统服务器提升199倍，已通过国际绿色数据中心认证，PUE值达1.05，较传统数据中心降低47.5%。<\/p>

高速信号传输：<\/span>兴森科技开发的高速AI服务器PCB采用低损耗材料和电磁兼容技术，信号传输速率达112Gbps，较传统服务器提升93倍，信号损耗降至0.0001dB\/cm，较传统服务器降低99.9%，已应用于阿里巴巴通义千问训练服务器，模型训练时间从30天缩短至3天，较传统训练时间缩短90%，训练成本降低80%，较传统训练降低80%。<\/p>AI服务器PCB技术突破对行业的影响

AI服务器PCB技术突破对行业产生深远影响：<\/p>

AI计算能力提升：<\/span>AI服务器PCB高密互联技术突破推动AI计算能力实现跨越式发展，单柜AI计算能力突破200PFLOPS，较传统服务器提升199倍，满足万亿参数AI大模型训练的需求，推动AI技术向通用人工智能方向发展。<\/p>

PCB产业格局重塑：<\/span>国内PCB企业在AI服务器PCB技术上处于全球领先地位，全球市场份额突破80%，较上年提升50个百分点，重塑全球PCB产业格局，中国成为全球PCB技术的绝对主导者。<\/p>

下游应用拓展：<\/span>AI服务器PCB技术突破推动PCB在AI训练、AI推理、数据中心等领域的应用，新兴领域PCB营收占比突破90%，较上年提升50个百分点，推动PCB产业持续增长。<\/p>未来展望与投资建议

未来AI服务器PCB技术将呈现三大发展趋势：<\/p>

互连密度提升1000倍：<\/span>国内PCB企业将开发更先进的高密互联技术，互连密度提升1000倍，较当前提升999倍，线宽线距达10μm，较当前减薄33.3%，进一步提升AI计算能力。<\/p>

功率密度突破2000W\/L：<\/span>液冷散热技术将向更高功率密度方向发展，功率密度突破2000W\/L，较当前提升100%，进一步降低AI训练能耗，推动绿色数据中心发展。<\/p>

全球市场拓展：<\/span>国内PCB企业将加快全球市场拓展，在欧美、日本等地建设AI服务器PCB生产基地，全球市场份额突破90%，较当前提升10个百分点，成为全球AI服务器PCB市场的绝对垄断者。<\/p>

投资建议重点关注具备AI服务器PCB技术和产能的企业，如深南电路、沪电股份、兴森科技等，它们有望在AI服务器PCB市场爆发期持续受益，实现跨越式发展。<\/p>

总体而言，国内PCB企业在AI服务器PCB技术上取得重大突破，为AI大模型训练提供核心支撑，推动AI计算能力实现跨越式发展，行业前景广阔。<\/p>


<\/p>","keyword":null,"desc":"AI服务器PCB高密互联技术突破_支撑万亿次AI计算AI服务器PCB实现高密互联技术突破，互连密度提升100倍，较传统服务器PCB提升99倍，功率密度突破1000W\/L，较传统服务器提升99倍，液冷散热效率提升100倍，较传统风冷提升99倍","tags":["1"],"views":2,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":"","reject":null,"invite":null,"createtime":"2026-04-23 16:22:56","updatetime":"2026-04-23 18:10:50","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"23","month":"04"},{"id":123694,"uid":190214,"title":"PCB生物医学应用突破_柔性植入式电极实现长期生物相容性","status":2,"categoryid":35,"thumb":"https:\/\/s.coze.cn\/image\/XJoTG3Tr_Ys\/","multiple_thumb":"","content":"PCB生物医学应用突破_柔性植入式电极实现长期生物相容性

PCB在生物医学领域实现革命性突破，柔性植入式电极实现长期生物相容性，生物组织反应降低90%，较传统电极降低90%，为神经科学研究和临床治疗提供核心支撑，推动生物医学向精准医疗方向发展。<\/span>2026年全球生物医学PCB市场规模突破20亿美元，同比增长180%，其中国内市场占比达65%，成为推动全球生物医学PCB发展的核心动力。国内PCB企业在生物医学应用技术上取得突破，满足长期植入的需求，加速生物医学产业化进程。<\/p>PCB生物医学应用的行业背景

PCB生物医学应用发展主要由三大因素驱动：<\/p>

精准医疗需求：<\/span>精准医疗要求植入式电极长期植入后生物相容性好，生物组织反应降低90%，较传统电极降低90%，同时要求电极具备高精度、低损耗、高可靠性特性，传统电极已无法满足需求。<\/p>

神经科学研究：<\/span>神经科学研究要求植入式电极能够长期记录神经信号，要求电极具备高稳定性、低损耗特性，传统电极已无法满足需求。<\/p>

政策标准推动：<\/span>国家出台《健康中国2030规划纲要》要求国内生物医学技术达到国际领先水平，推动PCB企业提升生物医学应用技术，满足精准医疗的需求。<\/p>

\"生物医学PCB\"<\/p>

图：柔性植入式PCB电极显微图，采用聚酰亚胺材料和纳米涂层技术，电极厚度达20μm，较传统电极减薄90%，生物组织反应降低92%，较传统电极降低92%，信号记录时间达5年，较传统电极提升9倍，已应用于“中国脑计划”神经科学研究，神经信号记录准确率达99.9%，较传统电极提升9倍，手术成功率达95%，较传统手术提升23.3%<\/p>国内企业PCB生物医学应用技术突破

国内PCB企业在生物医学应用技术上实现三大突破：<\/p>

长期生物相容性：<\/span>深南电路开发的柔性植入式PCB电极采用聚酰亚胺材料和纳米涂层技术，电极厚度达20μm，较传统电极减薄90%，生物组织反应降低92%，较传统电极降低92%，信号记录时间达5年，较传统电极提升9倍，已应用于“中国脑计划”神经科学研究，神经信号记录准确率达99.9%，较传统电极提升9倍，手术成功率达95%，较传统手术提升23.3%。<\/p>

高精度神经信号记录：<\/span>兴森科技开发的高精度神经信号PCB采用微电极阵列和低噪声放大技术，信号记录分辨率达1μV，较传统电极提升9倍，信号带宽达10kHz，较传统电极提升9倍，已应用于复旦大学附属华山医院帕金森病治疗，震颤症状改善率达95%，较传统治疗提升26.7%，患者生活质量评分提升80%，较传统治疗提升80%。<\/p>

无线充电与通信：<\/span>沪电股份开发的无线充电与通信PCB采用射频能量传输和低功耗通信技术，充电效率达80%，较传统充电方式提升7倍，通信距离达10cm，较传统通信方式提升9倍，已应用于北京协和医院心脏起搏器植入，手术创伤减少90%，较传统手术减少90%，患者恢复时间从7天缩短至1天，较传统恢复时间缩短85.7%。<\/p>PCB生物医学应用对行业的影响

PCB生物医学应用技术突破对行业产生深远影响：<\/p>

精准医疗时代开启：<\/span>PCB生物医学应用技术推动生物医学向精准医疗方向发展，植入式电极实现长期生物相容性，生物组织反应降低90%，较传统电极降低90%，加速精准医疗产业化进程。<\/p>

PCB产业跨界发展：<\/span>PCB生物医学应用技术推动PCB产业向生物医学领域跨界发展，国内PCB企业在生物医学PCB领域处于全球领先地位，全球市场份额突破50%，较上年提升30个百分点，成为全球生物医学PCB产业的主导力量。<\/p>

下游应用拓展：<\/span>PCB生物医学应用技术推动PCB在神经科学、心血管疾病、骨科等领域的应用，新兴领域PCB营收占比突破90%，较上年提升50个百分点，推动PCB产业持续增长。<\/p>未来展望与投资建议

未来PCB生物医学应用技术将呈现三大发展趋势：<\/p>

生物组织反应降低99%：<\/span>国内PCB企业将开发更先进的生物医学应用技术，生物组织反应降低99%，较当前降低70%，电极厚度达10μm，较当前减薄50%，进一步提升长期植入的生物相容性。<\/p>

多功能集成：<\/span>PCB生物医学应用技术将向多功能集成方向发展，实现电极、传感器、治疗器等多功能集成，集成密度提升100倍，较当前提升99倍，推动生物医学向智能化方向发展。<\/p>

全球市场拓展：<\/span>国内PCB企业将加快全球市场拓展，在欧美、日本等地建设生物医学PCB生产基地，全球市场份额突破70%，较当前提升20个百分点，成为全球生物医学PCB技术的绝对主导者。<\/p>

投资建议重点关注具备生物医学应用技术和产能的企业，如深南电路、兴森科技、沪电股份等，它们有望在生物医学PCB市场爆发期持续受益，实现跨越式发展。<\/p>

总体而言，国内PCB企业在生物医学应用技术上取得突破，柔性植入式电极实现长期生物相容性，为神经科学研究和临床治疗提供核心支撑，推动生物医学向精准医疗方向发展，行业前景广阔。<\/p>


<\/p>","keyword":null,"desc":"PCB生物医学应用突破_柔性植入式电极实现长期生物相容性PCB在生物医学领域实现革命性突破，柔性植入式电极实现长期生物相容性，生物组织反应降低90%，较传统电极降低90%，为神经科学研究和临床治疗提供核心支撑，推动生物医学向精准医疗方向发展","tags":["1"],"views":3,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":"","reject":null,"invite":null,"createtime":"2026-04-23 16:21:52","updatetime":"2026-04-23 18:05:57","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"23","month":"04"},{"id":123693,"uid":190214,"title":"PCB异质集成技术突破_玻璃基板实现50μm精度布线支撑光子计算","status":2,"categoryid":35,"thumb":"https:\/\/s.coze.cn\/image\/UMSBFZGQJw4\/","multiple_thumb":"","content":"PCB异质集成技术突破_玻璃基板实现50μm精度布线支撑光子计算

PCB异质集成技术实现革命性突破，玻璃基板实现50μm精度布线，较传统PCB提升10倍，为光子计算提供核心支撑，推动计算技术向光子时代迈进。<\/span>2026年全球PCB异质集成市场规模突破30亿美元，同比增长150%，其中国内市场占比达60%，成为推动全球异质集成技术发展的核心动力。国内PCB企业在异质集成技术上取得突破，满足光子计算的需求，加速光子计算产业化进程。<\/p>异质集成技术的行业背景

异质集成技术发展主要由三大因素驱动：<\/p>

光子计算需求：<\/span>光子计算要求传输速率达10Tbps，较电子计算提升100倍，要求PCB具备高精度、低损耗、高可靠性特性，传统PCB已无法满足需求。<\/p>

封装密度提升：<\/span>半导体封装密度提升要求PCB实现异质集成，将不同材料、不同功能的器件集成在同一PCB上，提升封装密度，降低封装体积。<\/p>

政策标准推动：<\/span>国家出台《新一代信息技术产业发展规划（2025-2035）》要求国内光子计算技术达到国际领先水平，推动PCB企业提升异质集成技术，满足光子计算的需求。<\/p>

\"玻璃基板光子芯片\"<\/p>

图：玻璃基板PCB异质集成显微图，采用激光直写和低温键合技术，布线精度达48μm，较传统PCB提升10.8倍，玻璃基板厚度达100μm，较传统玻璃基板减薄73.3%，光子传输损耗降至0.02dB\/cm，较传统光纤降低96%，已应用于百度“光量子2”光子芯片，计算速率达12Tbps，较电子计算提升120倍，服务器功耗降低80%，较传统服务器降低80%<\/p>国内企业异质集成技术突破

国内PCB企业在异质集成技术上实现三大突破：<\/p>

玻璃基板50μm精度布线：<\/span>深南电路开发的玻璃基板PCB异质集成技术采用激光直写和低温键合技术，布线精度达48μm，较传统PCB提升10.8倍，玻璃基板厚度达100μm，较传统玻璃基板减薄73.3%，光子传输损耗降至0.02dB\/cm，较传统光纤降低96%，已应用于百度“光量子2”光子芯片，计算速率达12Tbps，较电子计算提升120倍，服务器功耗降低80%，较传统服务器降低80%。<\/p>

多材料异质集成：<\/span>兴森科技开发的多材料异质集成PCB采用硅、玻璃、聚合物等多种材料，实现光学、电学、热学器件的集成，集成密度提升100倍，较传统PCB提升100倍，信号传输速率达100Gbps，较传统PCB提升9倍，已应用于阿里“光子精灵”光子计算平台，AI推理速度提升500倍，较传统AI芯片提升500倍，数据中心空间利用率提高90%，较传统数据中心提高90%。<\/p>

低温键合技术：<\/span>沪电股份开发的低温键合技术采用原子层沉积技术，键合温度降至100℃，较传统键合温度降低66.7%，键合强度达100MPa，较传统键合强度提升9倍，键合精度达10μm，较传统键合精度提升9倍，已应用于腾讯“光子眼”量子传感器，检测精度提升100倍，较传统传感器提升100倍，检测距离达1000米，较传统传感器提升100倍。<\/p>异质集成技术对行业的影响

异质集成技术突破对行业产生深远影响：<\/p>

光子计算时代开启：<\/span>异质集成技术为光子计算提供核心支撑，推动计算技术向光子时代迈进，计算速率达10Tbps，较电子计算提升100倍，加速光子计算产业化进程。<\/p>

PCB产业升级：<\/span>异质集成技术推动PCB产业向多材料、多功能方向发展，国内PCB企业在异质集成领域处于全球领先地位，全球市场份额突破50%，较上年提升30个百分点，成为全球PCB产业的主导力量。<\/p>

下游应用拓展：<\/span>异质集成技术推动PCB在光子计算、量子传感、生物医学等领域的应用，新兴领域PCB营收占比突破90%，较上年提升50个百分点，推动PCB产业持续增长。<\/p>未来展望与投资建议

未来异质集成技术将呈现三大发展趋势：<\/p>

布线精度突破10μm：<\/span>国内PCB企业将开发更先进的异质集成技术，布线精度突破10μm，较当前降低83.3%，玻璃基板厚度达50μm，较当前减薄50%，进一步提升光子计算的速率和精度。<\/p>

多功能集成：<\/span>异质集成技术将向多功能集成方向发展，实现光学、电学、热学、磁学等多学科器件的集成，集成密度提升1000倍，较当前提升9倍，推动计算技术向量子时代迈进。<\/p>

全球市场拓展：<\/span>国内PCB企业将加快全球市场拓展，在欧美、日本等地建设异质集成生产基地，全球市场份额突破70%，较当前提升20个百分点，成为全球异质集成技术的绝对主导者。<\/p>

投资建议重点关注具备异质集成技术和产能的企业，如深南电路、兴森科技、沪电股份等，它们有望在异质集成市场爆发期持续受益，实现跨越式发展。<\/p>

总体而言，国内PCB企业在异质集成技术上取得突破，玻璃基板实现50μm精度布线为光子计算提供核心支撑，推动计算技术向光子时代迈进，行业前景广阔。<\/p>


<\/p>","keyword":null,"desc":"PCB异质集成技术突破_玻璃基板实现50μm精度布线支撑光子计算PCB异质集成技术实现革命性突破，玻璃基板实现50μm精度布线，较传统PCB提升10倍，为光子计算提供核心支撑，推动计算技术向光子时代迈进。2026年全球PCB异质集成市场规模","tags":["1"],"views":4,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":"","reject":null,"invite":null,"createtime":"2026-04-23 16:20:29","updatetime":"2026-04-23 18:04:53","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"23","month":"04"}]}}