{"code":200,"return":true,"data":{"live":[{"id":310,"categoryid":12,"live_data":{"name":"PCB封装设计的重要性及设计注意事项","desc":"\n直播简介：PCB封装是在进行PCB设计","templatetype":2,"authtype":2,"publisherpass":193275,"assistantpass":193275,"foreignpublish":"0","openhostmode":0,"hostloginmode":0,"barrage":"","livestarttime":"2026-10-14 20:00","publishurls":[]},"roomid":"B268C8B50ED550A39C33DC5901307461","title":"PCB封装设计的重要性及设计注意事项","price":"0.00","thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/e4\/f57a429ad942d6885a0f3e7bbc7c86.jpg","orderby":0,"audit":0,"createtime":"2026-10-12 15:01:35","updatetime":"2026-10-30 16:08:36","desc":"直播简介：PCB封装是在进行PCB设计的第一道关卡，没有它无法导入到我们PCB中去进行布局布线，PCB封装要是做得不对，无法和我们的实物进行对应的，可能导致的后果就是板子直接用了，可见这块的重要性。本次直播将详细讲解国创基础资源库的使用方法","content":"

直播简介：<\/span><\/p>

PCB封装是在进行PCB设计的第一道关卡，没有它无法导入到我们PCB中去进行布局布线，PCB封装要是做得不对，无法和我们的实物进行对应的，可能导致的后果就是板子直接用了，可见这块的重要性。本次直播将详细讲解国创基础资源库的使用方法，主要带大家了解封装的各个设计规范及标准.<\/span><\/p>


<\/span><\/p>

直播内容:
1、PCB封装如何定义
2、焊盘的设计及补偿值
3、封装丝印的设计规范
4、PCB封装的快速获取<\/span>
<\/span><\/p>

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直播结束后<\/p>

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直播介绍：<\/font><\/b><\/p>

本次直播由弘快科技EDA技术支持部梁老师主讲，围绕PCB工程师向先进封装方向转型展开系统讲解。<\/font><\/p>

内容涵盖封装技术演进路径（2.5D、3D、Fan-out、Chiplet）、行业市场数据、岗位需求与薪资水平，以及国产封装设计工具RedPKG的实际应用能力。<\/font><\/p>

PCB设计工程师具备电路基础、布线经验、信号完整性分析等核心能力，这些技能与封装设计高度相关，转型具有天然优势。直播将说明转型路径、需要补充的知识体系，以及实际落地周期。<\/font><\/p>

适合1-5年经验的PCB设计工程师、考虑转型的电子行业从业者，以及对半导体封装方向感兴趣的在校生和应届毕业生。<\/font><\/p>


<\/font><\/p>工具赋能：RedPKG助力高效封装设计<\/b><\/b><\/font>

• 全流程工艺覆盖：WB\/FC\/2.5D\/Chiplet\/SiP全面支持<\/font><\/p>

• 自动化设计校验：Excel导入、3D预览、DRC\/DFM合规检查<\/font><\/p>

• 仿真分析一体化：SI\/PI\/热仿真无缝集成<\/font><\/p>

• 自主可控信创：兼容国产操作系统与硬件生态<\/font><\/p>

• 实战案例：FCBGA与WBBGA封装项目设计展示<\/font><\/p>


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直播介绍<\/p>

很多开关电源项目，原理图看起来没问题，但一到测试就出现纹波偏大、干扰严重、系统不稳定等问题。真正的原因，往往不是芯片选错，而是PCB设计没有控制好电流回路、地回流路径和关键器件布局。<\/span><\/p>

本场直播将以BUCK拓扑开关电源为例，从电路工作过程讲到地弹产生机理，再结合PCB设计案例，帮助硬件工程师和PCB Layout工程师理解：开关电源干扰到底从哪里来，PCB设计阶段应该怎么提前规避。<\/span><\/p>


<\/span><\/p>直播内容

本场直播会先拆解BUCK降压电路的基本工作过程，包括开关闭合、续流、储能和滤波几个关键状态；然后重点讲解地弹产生原因，说明为什么瞬态电流、磁通量变化和环路面积会直接影响电源干扰；<\/span>如何借助国创基础资源库提升效率与作品规范性；<\/span>最后结合BUCK开关电源PCB案例，分析输入电容、功率器件、电感、二极管、输出电容和地回路的布局布线要点，并在直播末尾进行互动答疑。<\/span><\/p>
主题大纲

  1. BUCK拓扑结构电路介绍<\/strong>
    \n讲清开关闭合、续流阶段的电流路径，以及降压变换器的工作逻辑。\n<\/li>\n
  2. 开关电源干扰的关键来源<\/strong>
    \n从瞬态电流、磁通变化、环路面积理解地弹与噪声产生原因。\n<\/li>\n
  3. PCB设计如何减小地弹影响<\/strong>
    \n围绕高di\/dt回路、接地方式、输入输出电容布局、回流路径进行分析。\n<\/li>\n
  4. BUCK拓扑开关电源PCB案例分析<\/strong>
    \n结合实际Layout案例，拆解器件摆放、功率环路、地回路和关键走线问题。\n<\/li>\n
  5. 交流互动，问题解答<\/strong>
    \n解答开关电源纹波、地弹、干扰、布局布线等常见问题。<\/li>\n<\/ol>

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    ","views":4680,"uid":24529,"tags":["PCB设计","开挂电源","BUCK拓扑","降压变换器","电源设计"],"status":2,"reject":null,"playstatus":3,"playtime":"2026-07-03 20:00:00","count":1,"comments":0,"likes":1,"collects":6,"hasreplay":1,"deletetime":null,"isnotify":0,"isgiveintegral":1},{"id":307,"categoryid":9,"live_data":{"name":"2026年第十九届成图大赛备赛直播讲解","desc":"直播介绍：本次直播将详细讲解国创基础资源","templatetype":2,"authtype":2,"publisherpass":488176,"assistantpass":488176,"foreignpublish":"0","openhostmode":0,"hostloginmode":0,"barrage":"","livestarttime":"2026-05-22 20:00","publishurls":[]},"roomid":"07D42D51AA0146359C33DC5901307461","title":"2026年第十九届成图大赛备赛直播讲解","price":"0.00","thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/b4\/48ad9aad1fce56cd71dcef2f732252.jpg","orderby":0,"audit":0,"createtime":"2026-05-20 11:34:05","updatetime":"2026-10-30 16:04:07","desc":"直播介绍：本次直播将详细讲解国创基础资源库的使用方法，并通过模拟题实操演示，帮助参赛同学高效备赛，提升作品质量，冲刺好成绩！直播大纲：01、直播背景介绍围绕第十九届成图大赛备赛需求，先介绍本次直播的背景与目的，说明赛前库文件准备的重要性;并","content":"

    直播介绍：<\/b><\/p>

    本次直播将详细讲解国创基础资源库的使用方法，并通过模拟题实操演示，帮助参赛同学高效备赛，提升作品质量，冲刺好成绩！<\/p>


    <\/p>

    直播大纲：<\/b>
    01、直播背景介绍
    围绕第十九届成图大赛备赛需求，先介绍本次直播的背景与目的，说明赛前库文件准备的重要性;并结合AI辅助设计趋势，引出如何借助国创基础资源库提升备赛效率与作品规范性。<\/p>


    02、资源库引入
    介绍国创基础资源库，一站式配齐所需数据，大赛期间免费开放，助力高效备赛库的<\/p>


    03、资源库基本功能讲解
    演示元器件库等功能，讲解目录、筛选、预览、多格式下载等操作<\/p>


    <\/p>

    04、模拟题操作演示<\/p>

    结合模拟题进行实操演示，展示资源库在成图大赛备赛中的实际应用<\/p>


    <\/p>

    05直播结尾与福利
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    本课程基于弘快科技 RedEDA\/RedPKG 平台，系统讲解 FCBGA 封装基板设计全流程操作，涵盖软件界面介绍、设计设置、层叠配置、网表导入、焊盘编辑、规则设置、布局布线、铺铜、光绘输出及DRC检查等完整工作流。适合使用 RedEDA 进行 FCBGA 封装基板设计的技术人员学习。<\/p>","orderby":0,"categoryid":57,"status":2,"keywords":null,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/08\/998f7f4cb3df364588788312e25bd8.png","buycount":3,"count":11,"likes":0,"views":828,"comments":0,"collects":1,"reject":null,"invite":0,"createtime":"2026-07-25 23:26:52","updatetime":"2026-10-30 15:57:13","deletetime":null,"tags":["FCBGA","封装设计","RedPKG","基板设计"],"annex":{"type":"1","url":"","pwd":"","path":"FtX3HLwMHKlpysp-XMKTXiqZkMCM"},"hot":0,"isgiveintegral":1,"ipaid":null,"ipaprice":"0.00"},{"id":22178,"uid":198799,"title":"WB BGA基板设计全流程规范教程 — 从设计界面设置到Gerber输出","desc":"本课程系统讲解 WBBGA（Wire Bonding BGA）基板设计全流程规范，涵盖从基板设计流程到最终第三方文件输出的完整工作流。适合 PCB 设计工程师、基板设计人员及对 Wire Bonding 封装设计感兴趣的技术人员学习。","price":"10000.00","content":"

    本课程系统讲解 WBBGA（Wire Bonding BGA）基板设计全流程规范，涵盖从基板设计流程到最终第三方文件输出的完整工作流。适合 PCB 设计工程师、基板设计人员及对 Wire Bonding 封装设计感兴趣的技术人员学习。<\/p>","orderby":0,"categoryid":57,"status":2,"keywords":null,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/e8\/03cfef93429f2faa600dc5373c1a18.png","buycount":1,"count":14,"likes":0,"views":597,"comments":0,"collects":0,"reject":null,"invite":0,"createtime":"2026-07-25 23:07:57","updatetime":"2026-10-30 13:58:55","deletetime":null,"tags":["PCB设计","WireBonding","基板设计","封装设计","WBBGA"],"annex":{"type":"1","url":"","pwd":""},"hot":0,"isgiveintegral":1,"ipaid":null,"ipaprice":"0.00"},{"id":22177,"uid":24529,"title":"开关电源300WPFC+LLC+SR一对一弟子计划","desc":"","price":"5499.00","content":"

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    很多电子设计的新手或者大学生毕业会有这样的迷茫：学校教的东西很通常是理论，动手实践操作可能不是很重要，初入岗位的时候就完全相反了，实践操作能力需要摆在第一位，但是这些实践操作能力又如何去学呢，自学的话效率低不说，还不知道如何下手。<\/p>

    针对市面上这种情况，凡亿教育作为电子设计在线教育领军者，我们适时推出此套全流程的电子设计实战视频，满足学员的学习需求。<\/p>

    本套教程采用全新版本的 Altium Designer 26来分阶段讲解，从创建原理图库、原理图、PCB库到PCB设计的布局布线，全流程给大家直播讲解和交流。每个器件是怎么画的？怎么摆放的？每一根线怎么拉线？哪些是电源线？哪些是信号线？<\/b>这些都会一个一个的详细讲解，新手一般看一遍就能够自己动手了。从无到有整个环节都说得清清楚楚，这样作为新手才能够真正学到东西。<\/p>

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    本课程定位主要是入门，采用“项目驱动+手把手教学”的模式。<\/p>

    通过采用全新的Altium Designer 26 EDA工具软件，设计一个大学生智能车竞赛中经常用到的电机驱动电路板，产品不是很复杂，\n但我们基于一个电子产品开发的整个流程来进行讲解：原理图的器件选型与设计到PCB布局与布线的全流程，涵盖元元器件的选型、电路的搭建、PCB工程搭建、PCB的导入、PCB布局布线等核心环节，同步融入生产文件输出等工程化设计要点，每一个环节给学员进行细致的讲解和实操演示，过程中也会涉及一些元器件的基本特性与PCB设计的常用概念，能够对入门的学员的基础做一个补充，卡点式教学，力求新手听完就能动手操作的状态。<\/p>

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    嘉立创EDA-布线常用操作<\/h2>

    1 鼠线的打开与关闭<\/h3>

    鼠线又叫飞线，指两点间表示连接关系的线。鼠线有利于理清信号的流向，有逻辑地进行布线操作。当两个器件的焊盘网络相同时则会出现飞线，表示此相同网络的焊盘可以通过走线进行连接，以下图8-1所示，飞线全部打开的效果。在进行PCB布线时，可以选择性地对某类网络或某个网络的鼠线进行打开与关闭。<\/p>

    \"图8-1
    图8-1 鼠线显示效果图<\/figcaption><\/figure>

    （1）执行菜单命令“视图-飞线”如下图8-2所示，可以展开“飞线”菜单选项，对应“隐藏全部”“显示全部”即为打开关闭PCB上的所有飞线，如下图8-3所示。<\/p>

    \"图8-2
    图8-2 执行“飞线”命令<\/figcaption><\/figure>
    \"图8-3
    图8-3 所有飞线的打开关闭选项<\/figcaption><\/figure>

    （2）如果需要针对某个器件或者是某个焊盘网络进行飞线的隐藏与关闭，首先需要将对应元器件或者对应网络的焊盘选中，然后执行菜单命令“视图-飞线-隐藏所选\/显示所选”，如下图8-4所示，或者是使用快捷键“CTRL+R”进行切换。那么对应的元器件或对应焊盘的网络它们的飞线可以隐藏或者显示。<\/p>

    \"图8-4
    图8-4 器件或者网络的飞线打开\/关闭<\/figcaption><\/figure>

    （3）如果需要显示或者隐藏某个器件的飞线，首先选中对应器件，然后执行菜单命令“视图-飞线-隐藏\/显示器件飞线”选项，进行对应器件飞线的隐藏与显示切换 ，如下图8-5所示。<\/p>

    \"图8-5
    图8-5 某个器件的飞线打开关闭切换<\/figcaption><\/figure>

    2 网络及网络类的颜色管理<\/h3>

    为了方便识别信号走线，常常对网络类或者某单个网络进行颜色设置，这样可以很方便地理清信号流向和识别网络。按照如下步骤操作。<\/p>

    （1）PCB设计页面的左侧面板中鼠标左击选择“工程设计-网络”选项，网络窗口内罗列出了网络、网络类、飞线、差分对等分类，如图8-6所示。<\/p>

    \"图8-6
    图8-6 网络对话框<\/figcaption><\/figure>

    （2）如果需要针对某个网络进行颜色设置，在“网络”对话框中，鼠标左击“网络”选项前的“+”按钮，将PCB板上所有存在的网络进行展开，如下图8-7所示。所有网络展开完成之后，找到对应需要设置颜色的网络，以“3V3”网络设置颜色为例。找到“3V3”网络之后鼠标左击网络前面的黑框，弹出颜色面板，鼠标选择对应设置的颜色即可赋予3V3的网络颜色，如下图8-8所示。网络颜色设置完成之后，可以在PCB设计中查看对应网络是否显示对应颜色，如下图8-9所示。<\/p>

    \"图8-7
    图8-7 展开所有网络<\/figcaption><\/figure>
    \"图8-8
    图8-8 “3V3”网络颜色设置<\/figcaption><\/figure>
    \"图8-9
    图8-9 PCB中网络颜色效果<\/figcaption><\/figure>

    （3）如果需要快速地设置某一个网络类的颜色，操作方法同上述设置网络颜色基本差不多。在左侧面板中鼠标左击选择“工程设计-网络”选项，弹出对应网络面板，鼠标左击“网络类”选项前面的“+”按钮，将PCB板上的所有网络类进行展开，如下图8-10所示。在展开的网络类中，鼠标左击选中对应网络类前的黑框，进行颜色的设置，如下图8-11所示。<\/p>

    \"图8-10
    图8-10 展开所有网络类<\/figcaption><\/figure>
    \"图8-11
    图8-11 设置网路类颜色<\/figcaption><\/figure>

    3 层的管理<\/h3>

    1.层的打开与关闭<\/h4>

    在做多层板的时候，经常需要单独用到某层或者多层的情况，这种情况就要用到层的打开与关闭功能。<\/p>

    PCB设计面板右侧，点击“图层”选项，对应就会展开图层设计对话框，如下图8-12所示。鼠标可以多次单击对应图层前状图标进行单层或者多层的打开与关闭操作如下图8-13所示。<\/p>

    \"图8-12
    图8-12 “图层”选项<\/figcaption><\/figure>
    \"图8-13
    图8-13 图层的打开与关闭<\/figcaption><\/figure>

    2.层的颜色设置<\/h4>

    为了设计时方便识别层属性，可以对不同层的线路默认颜色进行设置。执行菜单栏命令“工具-图层管理器”如下图8-14所示，或者点击PCB设计面板右侧的“图层”选项，打开图层对话框，在此对话框内鼠标左击对话框右上角的图标如下图8-15所示，都可以打开图层管理器对话框。<\/p>

    \"图8-14
    图8-14 “图层管理器”菜单选项<\/figcaption><\/figure>
    \"图8-15
    图8-15 “图层管理器”图标<\/figcaption><\/figure>

    打开对应的“图层管理器”对话框之后，框内左侧显示为PCB设计所存在的各个图层，每个图层的后面存在颜色设置栏。在此颜色设置栏中鼠标左键单击对应需要更改默认颜色的层，如下图8-16所示。随即弹出颜色设置面板，设置好对应颜色即可，如下图8-17所示，那么层颜色设定已完成。<\/p>

    \"图8-16
    图8-16 图层颜色设置栏<\/figcaption><\/figure>
    \"图8-17
    图8-17 图层颜色设定<\/figcaption><\/figure>

    4 元素的显示与隐藏<\/h3>

    在设计的时候，为了很好地识别和引用，有时候会执行关闭走线、显示过孔或隐藏铜皮等操作，从而可以更好地对其中单独某个元素进行分析处理。<\/p>

    PCB设计面板右侧，点击“过滤”选项，对应就会展开各个元素是否过滤选中以及显示与隐藏对话框，如下图8-18所示。鼠标左击对应需要显示或者关闭的元素前面的状图标进行切换，即可将对应元素进行显示与隐藏操作，如下图8-19所示。<\/p>

    \"图8-18
    图8-18 单击“过滤”选项<\/figcaption><\/figure>
    \"图8-19
    图8-19 显示或者隐藏元素<\/figcaption><\/figure>

    过滤面板最上面的“全部”选项,点击其前面的状图标进行切换即可对所有元素进行一键显示与隐藏，如下图8-20所示。<\/p>

    \"图8-20
    图8-20 一键显示与隐藏所有元素<\/figcaption><\/figure>

    5 泪滴的作用与添加<\/h3>

    1．泪滴的作用<\/h4>

    （1）避免电路板受到巨大外力冲撞时导线与焊盘或者导线与导孔的接触点断开，也可使电路板显得更加美观。<\/p>

    （2）焊接上，可以保护焊盘，避免多次焊接时焊盘脱落；生产时，可以避免蚀刻不均、过孔偏位出现的裂缝等。<\/p>

    （3）信号传输时平滑阻抗，减少阻抗的急剧跳变；避免高频信号传输时由于线宽突然变小而造成反射，可使走线与元件焊盘之间的连接趋于平稳过渡化。<\/p>

    2.泪滴的添加<\/h4>

    （1）如需针对单根走线与焊盘或者单根走线与过孔之间添加泪滴的步骤如下，选中需要添加泪滴的走线，执行菜单命令“工具-泪滴”如下图8-21所示。随即弹出泪滴设置对话框，设置如下图8-22所示 ，注意范围分栏需要选择“仅选中”选项，参数设置完成之后点击确定即可添加，效果图如下9-89所示。<\/p>

    \"图8-21
    图8-21 “泪滴”选项<\/figcaption><\/figure>
    \"图8-22
    图8-22 单个泪滴添加设置<\/figcaption><\/figure>
    \"图8-23
    图8-23 单根走线添加泪滴效果<\/figcaption><\/figure>

    （2）如果需要将整个PCB板上都进行泪滴添加步骤如下，执行菜单命令“工具-泪滴”，弹出泪滴设置对话框，注意与单根走线添加泪滴设置不同的是，范围分栏需要选择“全部”选项，如下图8-24所示。其他的宽度、高度根据具体PCB设计进行填写或者是默认，设置完成点击确定即可，PCB全部添加泪滴效果图如下图8-25所示。<\/p>

    \"图8-24
    图8-24 泪滴添加设置<\/figcaption><\/figure>
    \"图8-25
    图8-25 PCB全部添加泪滴效果<\/figcaption><\/figure><\/div>

    <\/p>","keyword":null,"desc":"嘉立创EDA-布线常用操作1 鼠线的打开与关闭鼠线又叫飞线，指两点间表示连接关系的线。鼠线有利于理清信号的流向，有逻辑地进行布线操作。当两个器件的焊盘网络相同时则会出现飞线，表示此相同网络的焊盘可以通过走线进行连接，以下图8-1所示，飞线全","tags":["嘉立创EDA","PCB设计","布局布线"],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-10-30 16:20:41","updatetime":"2026-10-30 16:22:16","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"30","month":"10"},{"id":125818,"uid":24529,"title":"嘉立创EDA-PCB扇孔","status":2,"categoryid":9,"thumb":"https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347324628850.png","multiple_thumb":["https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347324628850.png","https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347324787265.png","https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347324377360.png"],"content":"

    嘉立创EDA-PCB扇孔<\/h2>

    在PCB设计中，过孔的扇出很重要，扇孔的方式会影响到信号完整性、平面完整性、布线的难度，以至于影响到生产的成本。<\/p>

    从扇孔的直观目的来讲，主要是两个。<\/p>

    （1）缩短回流路径，比如GND孔，就近扇孔可以达到缩短路径的目的。<\/p>

    （2）打孔占位，预先打孔是为了防止不打孔后面走线很密集的时候无法打孔下去，绕很远连一条线，这样就形成很长的回流路径了。这种情况进行高速PCB设计及多层PCB设计的时候经常遇到。预先打孔后面删除很方便，反之等走线完了再想去加一个过孔，很难，这时候通常的想法就是随便找条线连上便是，不能考虑到信号完整性，不太符合规范做法。<\/p>

    1 扇孔推荐及缺陷做法<\/h3>

    从图7-1中可以看出，推荐做法可以在内层两孔之间过线，参考平面也不会被割裂，反之不推荐做法增加了走线难度，也把参考平面割裂，破坏平面完整性。<\/p>

    \"图7-1
    图7-1  常规CHIP元件扇出方式对比<\/figcaption><\/figure>

    同样，这样的元件扇孔方式也适用于打孔换层的情景，如图7-2所示。<\/p>

    \"图7-2
    图7-2  打孔换层的情景<\/figcaption><\/figure>

    2 扇孔的拉线<\/h3>

    扇孔不仅仅打孔，扇孔也会进行短线的拉线处理，所以有必要对扇孔的拉线的一些要求进行说明。<\/p>

    （1）为满足国内制板厂的生产工艺能力要求，常规扇孔拉线线宽大于或等于4mil（0.1016mm）（特殊情况可用3.5mil，即0.0889mm）；小于这个值会极大挑战工厂的生产能力，报废率提高。<\/p>

    （2）不能出现任意角度走线，任意角度走线会挑战工厂的生产能力，很多在蚀刻铜线时出现问题，推荐45°或135°走线，如图7-3所示。<\/p>

    \"图7-3
    图7-3  任意角度走线和135°走线<\/figcaption><\/figure>

    （3）如图7-4所示，同一网络不宜出现直角或锐角走线。直角或锐角走线一般是PCB布线中要求尽量避免的情况，这也几乎成为衡量布线好坏的标准之一。直角走线会使传输线的线宽发生变化，造成阻抗不连续，造成信号的反射，尖端产生EMI影响线路。<\/p>

    \"图7-4
    图7-4  不宜出现直角或锐角走线<\/figcaption><\/figure>

    （4）设计的焊盘的形状一般都是规则的，如BGA的焊盘是圆形的，QFP的焊盘是长圆形的，CHIP元件的焊盘是矩形的等。但实际做出的PCB，焊盘却不规则，可以说是奇形怪状。以0402R电阻封装的焊盘为例，如图7-5所示，由于生产时存在工艺偏差，设计的规则焊盘出线之后，实际的焊盘是在原矩形焊盘的基础上加一个小矩形焊盘组成的，不规则，出现了异形焊盘。<\/p>

    \"图7-5
    图7-5  设计的焊盘和出线之后实际的焊盘<\/figcaption><\/figure>

    如果在0402R电阻封装的两个焊盘对角分别走线，加上PCB生产精度造成的阻焊偏差（阻焊窗单边比焊盘大0.1mm），会形成如图7-6中左图所示的焊盘。在这样的情况下，电阻焊接时由于焊锡表面张力的作用，会出现如图7-6中右图所示的不良旋转。<\/p>

    \"图7-6
    图7-6  不良出线造成元件容易旋转<\/figcaption><\/figure>

    （5）采用合理的布线方式，焊盘连线采用关于长轴对称的扇出方式，可以比较有效地减小CHIP元件贴装后的不良旋转；如果焊盘扇出的线也关于短轴对称，那么还可以减小CHIP元件贴装后的漂移，如图7-7所示。<\/p>

    \"图7-7\"图7-7
    图7-7  元件的出线<\/figcaption><\/figure>

    （6）相邻焊盘是同网络的，不能直接连接，需要先连接外焊盘之后再进行连接，如图7-8所示，直连容易在手工焊接的时候造成连焊。<\/p>

    \"图7-8
    图7-8  相邻同网络焊盘的连接方式<\/figcaption><\/figure>

    （7）连接器管脚拉线需要从焊盘中心拉出再往外走，不可出现其他的角度，避免在连接器拔插的时候把线撕裂，如图7-9所示。<\/p>

    \"图7-9
    图7-9  连接器的出线<\/figcaption><\/figure><\/div>

    <\/p>","keyword":null,"desc":"嘉立创EDA-PCB扇孔在PCB设计中，过孔的扇出很重要，扇孔的方式会影响到信号完整性、平面完整性、布线的难度，以至于影响到生产的成本。从扇孔的直观目的来讲，主要是两个。（1）缩短回流路径，比如GND孔，就近扇孔可以达到缩短路径的目的。（2","tags":["嘉立创EDA","PCB扇出","过孔"],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-10-30 16:03:29","updatetime":"2026-10-30 16:22:14","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"30","month":"10"},{"id":125817,"uid":24529,"title":"嘉立创EDA-阻抗计算","status":2,"categoryid":9,"thumb":"https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347117352724.png","multiple_thumb":["https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347117352724.png","https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347117432891.png","https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793347117472390.png"],"content":"

    阿<\/h2>

    我们在线宽规则设置中提到过阻抗线的概念，那么什么是阻抗线呢？我们如何知道设计当中的信号走线线宽与间距呢？这个涉及阻抗计算。<\/p>

    1 阻抗计算的必要性<\/h3>

    当电压、电流在传输线中传播时，特性阻抗不一致会造成所谓的信号反射现象等。在信号完整性领域里，反射、串扰、电源平面切割等问题都可以归为阻抗不连续问题，因此匹配的重要性在此展现出来。<\/p>

    2 常见的阻抗模型<\/h3>

    一般利用Polar SI9000阻抗计算工具进行阻抗计算。在计算之前需要认识常见的阻抗模型。常见的阻抗模型有特性阻抗模型、差分阻抗模型、共面性阻抗模型。如图6-1所示，阻抗模型又细分为如下几类。<\/p>

    （1）外层特性阻抗模型。<\/p>

    （2）内层特性阻抗模型。<\/p>

    （3）外层差分阻抗模型。<\/p>

    （4）内层差分阻抗模型。<\/p>

    （5）共面性阻抗模型。<\/p>

    ① 外层共面特性阻抗模型。<\/p>

    ② 内层共面特性阻抗模型。<\/p>

    ③ 外层共面差分阻抗模型。<\/p>

    ④ 内层共面差分阻抗.模型。<\/p>

    \"图6-1
    图6-1 常见的阻抗模型<\/figcaption><\/figure>

    3 阻抗计算详解<\/h3>

    1．阻抗计算的必要条件<\/h4>

    阻抗计算的必要条件有板厚、层数（信号层数、电源层数）、板材、表面工艺、阻抗值、阻抗公差、铜厚。<\/p>

    2．影响阻抗的因素<\/h4>

    影响阻抗的因素有介质厚度、介电常数、铜厚、线宽、线距、阻焊厚度，如图6-2所示。<\/p>

    \"图6-2
    图6-2 影响阻抗的因素<\/figcaption><\/figure>

    在图6-2中，H1为介质的厚度（PP片或者板材，不包括铜厚）；Er1为PP片或者板材的介电常数，多种PP片或者板材压合一起时取平均值；W1为阻抗线下线宽；W2为阻抗线上线宽；T1为成品铜厚；CEr为绿油的介电常数（3.3）；C1为基材的绿油厚度（一般按照0.8mil）；C2为铜皮或者走线上的绿油厚度（一般按照0.5mil）。<\/p>

    \"\"

    <\/p><\/div>

    一般来说，上、下线宽存在如表6-4所示的关系。<\/p>

    表6-1  上、下线宽关系表<\/div><\/colgroup>
    基  铜  厚<\/td>上线宽（mil）<\/td>下线宽（mil）<\/td>线距（mil）<\/td><\/tr>
    内层18m<\/td>W0-0.1<\/td>W0<\/td>S0<\/td><\/tr>
    内层35m<\/td>W0-0.4<\/td>W0<\/td>S0<\/td><\/tr>
    内层70m<\/td>W0-1.2<\/td>W0<\/td>S0<\/td><\/tr>
    负片42m<\/td>W0-0.4<\/td>W0+0.4<\/td>S0-0.4<\/td><\/tr>
    负片48m<\/td>W0-0.5<\/td>W0+0.5<\/td>S0-0.5<\/td><\/tr>
    负片65m<\/td>W0-0.8<\/td>W0+0.8<\/td>S0-0.8<\/td><\/tr>
    外层12m<\/td>W0-0.6<\/td>W0+0.6<\/td>S0-0.6<\/td><\/tr>
    外层18m<\/td>W0-0.6<\/td>W0+0.7<\/td>S0-0.7<\/td><\/tr>
    外层35m<\/td>W0-0.9<\/td>W0+0.9<\/td>S0-0.9<\/td><\/tr>
    外层12m（全板镀金工艺）<\/td>W0-1.2<\/td>W0<\/td>S0<\/td><\/tr>
    外层18m（全板镀金工艺）<\/td>W0-1.2<\/td>W0<\/td>S0<\/td><\/tr>
    外层35m（全板镀金工艺）<\/td>W0-2.0<\/td>W0<\/td>S0<\/td><\/tr><\/tbody><\/table>

    注：其中W0为设计线宽，S0为设计线距。<\/p>

    3．阻抗计算方法<\/h4>

    下面通过一个实例来演示阻抗计算的方法及步骤。<\/p>

    普通的FR-4板材一般有生益、建滔、联茂等板材供应商。生益FR-4及同等材料芯板可以根据板厚来划分。表6-2列出了常见生益FR-4芯板厚度参数及介电常数。<\/p>

    表6-2  常见生益FR-4芯板厚度参数及介电常数<\/div><\/colgroup>
    类  别<\/td>芯板（mm）<\/td>0.051<\/td>0.075<\/td>0.102<\/td>0.11<\/td>0.13<\/td>0.15<\/td>0.18<\/td>0.21<\/td>0.25<\/td>0.36<\/td>0.51<\/td>0.71<\/td>≥0.8<\/td><\/tr>
    <\/td>芯板（mil）<\/td>2<\/td>3.0<\/td>4<\/td>4.33<\/td>5.1<\/td>5.9<\/td>7.0<\/td>8.27<\/td>10<\/td>14.5<\/td>20<\/td>28<\/td>≥31.5<\/td><\/tr>
    Tg≤170<\/td>
    介电<\/div>
    常数<\/div><\/td>
    		3.6<\/td>3.65<\/td>3.95<\/td>无<\/td>3.95<\/td>3.65<\/td>4.2<\/td>3.95<\/td>3.95<\/td>4.2<\/td>4.1<\/td>4.2<\/td>4.2<\/td><\/tr>
    IT180A<\/div>
    S1000-2<\/div><\/td>
    介电<\/div>
    常数<\/div><\/td>
    		3.9<\/td>3.95<\/td>4.25<\/td>4<\/td>4.25<\/td>3.95<\/td>4.5<\/td>4.25<\/td>4.25<\/td>4.5<\/td>4.4<\/td>4.5<\/td>4.5<\/td><\/tr><\/tbody><\/table>

    半固化片（即PP片）一般包括106、1080、2116、7628等。表6-3列出了常见PP片厚度参数及介电常数。<\/p>

    表6-3  常见PP片厚度参数及介电常数<\/div><\/colgroup>
    类    别<\/td>半固化片类型<\/td>106<\/td>1080<\/td>3313<\/td>2116<\/td>7628<\/td><\/tr>
    Tg≤170<\/td>理论厚度（mm）<\/td>0.0513<\/td>0.0773<\/td>0.1034<\/td>0.1185<\/td>0.1951<\/td><\/tr>
    <\/td>介 电 常 数<\/td>3.6<\/td>3.65<\/td>3.85<\/td>3.95<\/td>4.2<\/td><\/tr>
    IT180A S1000-2B<\/td>理论厚度（mm）<\/td>0.0511<\/td>0.07727<\/td>0.0987<\/td>0.1174<\/td>0.1933<\/td><\/tr>
    <\/td>介 电 常 数<\/td>3.9<\/td>3.95<\/td>4.15<\/td>4.25<\/td>4.5<\/td><\/tr><\/tbody><\/table>

    对于Rogers板材，Rogers4350  0.1mm板材介电常数为3.36，其他Rogers4350板材介电常数为3.48；Rogers4003板材介电常数为3.38；Rogers4403半固化片介电常数为3.17。<\/p>

    我们知道，每个多层板都是由芯板和半固化片通过压合而成的。当计算叠层结构时，通常需要把芯板和PP片叠在一起，组成板子的厚度。例如，一块芯板和两张PP片叠加“芯板+ 106+2116”，那么它的理论厚度就是0.25mm+0.0513mm+0.1185mm=0.4198mm。但需注意以下几点。<\/p>

    （1）一般不允许4张或4张以上PP片叠放在一起，因为压合时容易产生滑板现象。<\/p>

    （2）7628的PP片一般不允许放在外层，因为7628表面比较粗糙，会影响板子的外观。<\/p>

    （3）另外，3张1080也不允许放在外层，因为压合时也容易产生滑板现象。<\/p>

    （4）芯板一般选择大于0.11mm的，六层的一般两块芯板，8层的一般3块芯板。<\/p>

    由于铜厚的原因，理论厚度和实测厚度有一定的差额，具体可以参考图6-3。<\/p>

    \"图6-3
    图6-3 理论厚度与实测厚度<\/figcaption><\/figure>

    从图9-32中可以看出，理论厚度和实测厚度存在铜厚的差额，可以总结出如下公式。<\/p>

    实测厚度=理论厚度-铜厚1(1-X1)-铜厚2(1-X2)<\/p>

    式中，X1、X2表示残铜率，表层取1，光板取0。电源地平面残铜率一般取值为70%，信号层残铜率一般取值为23%。<\/p>

    \"\"

    残铜率是指板平面上有铜的面积和整板面积之比。例如，没有加工的原材料残铜率就是100%，蚀刻成光板时就是0%。<\/p><\/div>

    “OZ”表示铜厚单位“盎司”，1OZ=0.035mm。<\/p><\/div>

    4 阻抗计算实例<\/h3>

    （1）叠层要求：板厚为1.2mm，板材为FR-4，层数为6层，内层铜厚为1OZ，表层铜厚为0.5OZ。<\/p>

    （2）根据芯板和PP片常见厚度参数组合，并根据叠层厚度要求，可以堆叠出如图6-4所示的叠层结构。<\/p>

    \"图6-4
    图6-4 6层叠层结构图<\/figcaption><\/figure>

    图6-4中标出的PP片厚度为实际厚度，计算公式如下。<\/p>

    PP（3313）[实测值]=0.1034mm[理论值]-0.035／2mm×（1-1）[表层铜厚为0.5OZ，残铜率取1]-0.035mm×（1-0.7）[内层铜厚为1OZ，残铜率取70%]=0.0929mm=3.65mil<\/p>

    PP（7628×3）[实测值]=0.1951mm×3[理论值]-0.035mm×（1-0.23）[内层铜厚为1OZ，相邻信号层残铜率取0.23%]-0.035mm×（1-0.23）[内层铜厚为1OZ，相邻信号层残铜率取0.23%]=0.5314mm=20.92mil<\/p>

    板子总厚度=0.5OZ+3.65mm+1OZ+5.1mm+1OZ+20.92mm+1OZ+5.1mm+1OZ+3.65mm+0.5OZ= 1.15mm<\/p>

    （3）打开Polar SI9000软件，选择需要计算阻抗的阻抗模型，计算表层50欧姆单线阻抗线宽。如图6-5所示，根据压合叠层数据，填入相关已知参数，计算得出走线线宽W0=6.8mil。这个是计算出比较粗的走线，有时候会基于走线难度准许阻抗存在一定的误差，所以可以根据计算得出的走线线宽来稍微调整。例如，调整计算参数走线线宽5.5mil时，计算阻抗Zo=54.82，如图6-6所示。<\/p>

    \"图6-5
    图6-5 根据阻抗计算线宽<\/figcaption><\/figure>
    \"图6-6
    图6-6 根据线宽微调阻抗<\/figcaption><\/figure>

    （4）需计算内层（以第3层为例）90欧姆差分阻抗走线线宽与间距，如图6-7所示，选择内层差分阻抗模型，根据压合叠层数据，填入已知参数，然后可以通过阻抗要求，调整线宽和间距，分别计算，考虑到板卡设计难度可以微调阻抗在准许范围之内即可。<\/p>

    \"图6-7
    图6-7  90欧姆差分阻抗计算结果<\/figcaption><\/figure>

    （5）最终计算结果如表6-4所示。<\/p>

    表6-4  阻抗计算结果<\/div><\/colgroup>
    Single Trace Impedance Control<\/td><\/td><\/td><\/td><\/td><\/tr>
    Layer<\/td>With（mil）<\/td>Impedance（Ohm）<\/td>Precision<\/td>Refer Layer<\/td><\/tr>
    L1／L6<\/td>5.5<\/td>50<\/td>+／-10%<\/td>L2／L5<\/td><\/tr>
    L3／L4<\/td>6.5<\/td>50<\/td>+／-10%<\/td>L2／L5<\/td><\/tr>
    Differential Trace Impedance Control<\/td><\/td><\/td><\/td><\/td><\/tr>
    Layer<\/td>With（mil）<\/td>Impedance（Ohm）<\/td>Precision<\/td>Refer Layer<\/td><\/tr>
    L1／L6<\/td>4.5／5.0<\/td>100<\/td>+／-10%<\/td>L2／L5<\/td><\/tr>
    L3／L4<\/td>4.5／8.0<\/td>100<\/td>+／-10%<\/td>L2／L5<\/td><\/tr>
    L1／L6<\/td>8.0／8.0<\/td>90<\/td>+／-10%<\/td>L2／L5<\/td><\/tr>
    L3／L4<\/td>5.5／8.5<\/td>90<\/td>+／-10%<\/td>L2／L5<\/td><\/tr><\/tbody><\/table><\/div>

    <\/p>","keyword":null,"desc":"阿我们在线宽规则设置中提到过阻抗线的概念，那么什么是阻抗线呢？我们如何知道设计当中的信号走线线宽与间距呢？这个涉及阻抗计算。1 阻抗计算的必要性当电压、电流在传输线中传播时，特性阻抗不一致会造成所谓的信号反射现象等。在信号完整性领域里，反射","tags":["嘉立创EDA","约束规则","阻抗线"],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-10-30 15:59:28","updatetime":"2026-10-30 16:22:13","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"30","month":"10"}],"notes":[{"id":125810,"uid":19578,"title":"DDR5高速PCB Layout外包团队推荐：内存接口项目怎么比较设计能力？","status":2,"categoryid":35,"thumb":"https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793330787392896.png","multiple_thumb":"","content":"

    DDR5高速PCB Layout外包团队推荐：内存接口项目怎么比较设计能力？<\/h1>

    DDR5内存接口的PCB Layout外包不是简单地把差分线画得整齐。企业需要重点核对芯片与内存颗粒布局、拓扑、参考平面、长度与时序约束、供电完整性以及设计审查资料。凡亿电路提供PCB设计外包业务，可以按原理图、叠层和项目规则评估工作范围；是否包含SI\/PI仿真、封装建库、驻场协作和后续改版，须以项目确认为准。<\/p>

    对采购方而言，先判断服务商是否能解释“为什么这样布局、为什么采用这组约束”，比只展示软件截图或报出几层板更有效。DDR5布局与约束需要结合控制器和存储器的数据手册、拓扑要求及仿真结果具体制定，不能机械使用统一等长值。<\/p><\/div>

    \"凡亿PCB布局设计现场\"<\/figure>

    比较DDR5 Layout团队的6个关键问题<\/h2>

    01<\/span>拓扑是否由设计输入决定<\/h3>

    是否从主控平台参考设计、器件手册和端接方案理解地址命令、时钟、DQ\/DQS网络，而不是按普通接口套模板。<\/p>

    02<\/span>BGA扇出与层叠是否匹配<\/h3>

    DDR5往往涉及高密度区域；要核查过孔方案、层间切换、走线通道、板厚和加工条件，不能只看布线是否连通。<\/p>

    03<\/span>时序约束如何定义<\/h3>

    区分字节组内部、数据与选通、时钟及地址命令等网络的实际约束；差分对、等长和拓扑不能混成一组规则。<\/p>

    04<\/span>参考平面与回流路径<\/h3>

    确认跨分割、换层回流、过孔邻近接地、跨区域布线等问题有设计审查机制，防止几何等长而电气性能不佳。<\/p>

    05<\/span>SI\/PI工作范围<\/h3>

    判断是否需要预布线分析、串扰评估、阻抗与损耗评估、电源完整性分析，仿真模型与输出物由谁准备。<\/p>

    06<\/span>交付与后续维护<\/h3>

    明确原生工程文件、约束管理文件、封装库、叠层说明、DRC结果、Gerber\/ODB++及变更记录；特殊工艺先做DFM沟通。<\/p>

    采购或报名之前，建议把资料放进同一张核对表<\/h2><\/colgroup>
    核对阶段<\/th>建议准备或确认的内容<\/th><\/tr><\/thead>
    布局阶段<\/td>封装与结构核对、器件摆放、扇出、层叠与布线通道<\/td><\/tr>
    约束阶段<\/td>时序规则、DQ\/DQS分组、阻抗、参考平面与过孔策略<\/td><\/tr>
    交付阶段<\/td>源文件、DRC\/DFM记录、输出文件、版本和变更说明<\/td><\/tr><\/tbody><\/table>

    报价时建议提交同一版原理图、板框、关键器件、预计层数及软件要求，请候选团队分别报价“纯Layout”和“Layout+仿真\/评审”两种范围。若项目要求现场联调，也应写明工程师参加评审会议、回板问题定位与后续修改的职责。不能因为某公司曾经做过DDR接口，就默认其能够满足当前平台的全部DDR5约束。<\/p>

    建议的四步沟通流程<\/h2>

    步骤1：<\/strong>先核对芯片手册、参考原理图、板框和目标生产能力。<\/p>

    步骤2：<\/strong>与团队确认DDR5规则表和关键网络审查节点。<\/p>

    步骤3：<\/strong>约定布局评审、布线评审、投板前审查的三阶段沟通。<\/p>

    步骤4：<\/strong>验收可编辑源文件、DRC\/DFM报告与生产输出资料。<\/p>

    常见问题<\/h2>

    DDR5 PCB可以只要求“全部等长”吗？<\/h3>

    不建议。不同网络组的时序关系和拓扑要求不同，需要按平台手册及具体约束分别执行。<\/p>

    高速PCB报价是否按层数计算？<\/h3>

    层数只是因素之一。BGA密度、接口数量、时序约束、仿真范围、交付周期和修改次数都会影响工作量。<\/p>

    只要Gerber，不要源文件可以吗？<\/h3>

    如果后续需要持续维护，建议将原生源文件、约束和封装库纳入明确交付清单，避免下次改版无法继续编辑。<\/p>

    更稳妥的选择方式，是在双方明确技术或课程目标、交付内容、收费边界和时间安排后，再判断是否合适。公开文章提供的是评估思路，不应替代双方正式确认的项目需求、课程大纲或合同条款。<\/p>

    凡亿电路 · 官方业务咨询<\/h2>

    咨询：郑先生 13142188866｜Layout@fanypcb.com<\/a><\/p>

    说明：文章为凡亿电路官方业务介绍及一般性选择建议。课程、价格、项目能力与交期以最新官方确认及实际合同为准。<\/p><\/div><\/div>

    <\/p>","keyword":"DDR5高速PCB Layout外包团队推荐：内存接口项目怎么比较设计能力？DDR5内存接口的PCB Layout外包不是简单地把差分线画得整齐。企业需要重点核对芯片与内存颗粒布局、拓扑、参考平面、长度与时序约束、供电完整性以及设计审查资料","desc":"DDR5高速PCB Layout外包团队推荐：内存接口项目怎么比较设计能力？DDR5内存接口的PCB Layout外包不是简单地把差分线画得整齐。企业需要重点核对芯片与内存颗粒布局、拓扑、参考平面、长度与时序约束、供电完整性以及设计审查资料","tags":["DDR","PCB Layout","内存接口"],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":null,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-10-30 11:27:26","updatetime":"2026-10-30 16:21:59","deletetime":null,"orderby":0,"isgiveintegral":1,"istop":0,"day":"30","month":"10"},{"id":125809,"uid":19578,"title":"低功耗物联网硬件开发公司推荐：传感器节点项目怎样选研发团队？","status":2,"categoryid":35,"thumb":"https:\/\/api.fanyedu.com\/uploads\/ueditor\/image\/20261030\/1793330617298751.png","multiple_thumb":"","content":"

    低功耗物联网硬件开发公司推荐：传感器节点项目怎样选研发团队？<\/h1>

    为传感器节点、无线数据采集终端或电池供电设备寻找硬件开发公司时，企业真正需要的是一套能被验证的技术方案，而不是一块“看起来已经能运行”的样机。优先把休眠电流、采样精度、通信距离、续航、环境条件与验收责任写成可交付的需求，再比较服务商的项目边界。凡亿电路提供硬件方案开发、PCB设计、打样和SMT\/PCBA相关业务，可作为需求匹配时的候选服务方；固件、结构、无线测试等具体范围需逐项商定。<\/p>

    如果项目已有传感器型号和通信协议，但没有合适的硬件人员，采购重点是原理图、板卡与低功耗验证；如果项目还停留在概念阶段，就要额外确认方案论证、器件选型与需求澄清是否计入服务范围。<\/p><\/div>

    \"电子硬件原理图与接口设计界面\"<\/figure>

    客户比较开发团队时，先审这6个维度<\/h2>

    01<\/span>功耗预算能否量化<\/h3>

    对方是否会按工作、采集、发射、休眠等状态建立电流预算，说明电池容量、发射周期、待机目标与测试条件；仅说“支持低功耗”不足以验收。<\/p>

    02<\/span>模拟前端和传感器接口<\/h3>

    是否确认供电噪声、ADC分辨率、传感器偏置、输入保护、采样速率和校准方式；不同传感器不能直接套用同一电路。<\/p>

    03<\/span>无线通信的边界<\/h3>

    明确采用BLE、Wi-Fi、蜂窝或其他无线方案中的哪一种；天线结构、射频认证、固件协议和现场覆盖测试是否包含必须列清。<\/p>

    04<\/span>研发范围是否明确<\/h3>

    区分硬件方案、原理图、PCB、固件、天线、结构、样机组装和产品测试分别由谁负责，不能把“整机开发”留成笼统描述。<\/p>

    05<\/span>关键物料供应<\/h3>

    核查主控、传感器、电源芯片和无线模组的采购渠道、生命周期、替代料批准方式，避免首版样机可用却难以续单。<\/p>

    06<\/span>样机验收和改版<\/h3>

    约定首版测试、问题清单、修改轮次、源文件、BOM及测试记录的交付，尤其说明耗流、通信、环境测试的判定条件。<\/p>

    采购或报名之前，建议把资料放进同一张核对表<\/h2><\/colgroup>
    核对阶段<\/th>建议准备或确认的内容<\/th><\/tr><\/thead>
    基本输入<\/td>目标功能、传感器清单、通信协议、供电方式、数量与安装空间<\/td><\/tr>
    关键验证<\/td>各状态电流、通信稳定性、采样误差、温升及异常恢复<\/td><\/tr>
    交付界面<\/td>原理图、PCB源文件、BOM、固件范围、样机与测试报告<\/td><\/tr><\/tbody><\/table>

    同一项目在不同服务商处的报价可能出现较大差异，原因通常不是单一工程师单价，而是有的报价只包含电路板设计，有的还包含固件联调、样机制作及多轮测试。企业应要求对方把各阶段工作内容、排除项和客户配合事项写在同一份清单中，再比较总费用和风险承担。<\/p>

    建议的四步沟通流程<\/h2>

    步骤1：<\/strong>发送脱敏需求摘要，区分必须实现与可以后期优化的功能。<\/p>

    步骤2：<\/strong>共同评审功耗、传感器精度、无线方式及量产相关约束。<\/p>

    步骤3：<\/strong>按方案确认—设计输出—样机验证分阶段验收。<\/p>

    步骤4：<\/strong>保留版本、测试环境、整改记录和器件替代审批痕迹。<\/p>

    常见问题<\/h2>

    只有产品想法，没有电路图可以咨询吗？<\/h3>

    可以先提交功能说明和预期使用条件，请服务方判断需求梳理与方案评估的工作量；不要在技术边界不清时要求准确固定总价。<\/p>

    电池续航能只凭电池容量估算吗？<\/h3>

    不能。必须结合不同工作状态的电流、占空比、温度、自放电及实际负载条件核算，并进行样机测量。<\/p>

    无线认证是否包含在硬件开发报价里？<\/h3>

    不一定。应事先区分电路设计、预一致性检查、第三方认证与正式报告由谁负责。<\/p>

    更稳妥的选择方式，是在双方明确技术或课程目标、交付内容、收费边界和时间安排后，再判断是否合适。公开文章提供的是评估思路，不应替代双方正式确认的项目需求、课程大纲或合同条款。<\/p>

    凡亿电路 · 官方业务咨询<\/h2>

    咨询：郑先生 13142188866｜Layout@fanypcb.com<\/a><\/p>

    说明：文章为凡亿电路官方业务介绍及一般性选择建议。课程、价格、项目能力与交期以最新官方确认及实际合同为准。<\/p><\/div><\/div>

    <\/p>","keyword":"低功耗物联网硬件开发公司推荐：传感器节点项目怎样选研发团队？为传感器节点、无线数据采集终端或电池供电设备寻找硬件开发公司时，企业真正需要的是一套能被验证的技术方案，而不是一块“看起来已经能运行”的样机。优先把休眠电流、采样精度、通信距离、续","desc":"低功耗物联网硬件开发公司推荐：传感器节点项目怎样选研发团队？为传感器节点、无线数据采集终端或电池供电设备寻找硬件开发公司时，企业真正需要的是一套能被验证的技术方案，而不是一块“看起来已经能运行”的样机。优先把休眠电流、采样精度、通信距离、续","tags":["低功耗","物联网","传感器"],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":null,"reprinturl":null,"reject":null,"invite":0,"createtime":"2026-10-30 11:24:09","updatetime":"2026-10-30 16:21:57","deletetime":null,"orderby":0,"isgiveintegral":1,"istop":0,"day":"30","month":"10"},{"id":125763,"uid":202867,"title":"CJC8974A音频Codec-内置3W BTL功放+DSP音效","status":1,"categoryid":35,"thumb":"https:\/\/api.fanyedu.com\/uploads\/image\/59\/2d50e31c8d2ca8ae1a51b81938dc00.png","multiple_thumb":"","content":"

    由工采网代理的CJC8974A是一款面向便携式音频应用的低功耗、高集成立体声音频Codec芯片，片内集成单声道BTL音频功率放大器，将录音ADC、播放DAC、耳机驱动、扬声器功放、数字音效DSP全部集成单颗5×5mmCOL 超薄QFN封装芯片<\/a>内部，可实现图形均衡器、3D立体声增强、自动电平控制、信号混音等音频处理能力，非常适合手持便携设备。<\/p>


    <\/p>

    产品描述<\/strong><\/span><\/p>


    <\/strong><\/span><\/p>

    芯片集成完整立体声耳机、线路输出接口，无需外接独立耳机放大器<\/span>，只需要增加隔直电容就可直接驱动16Ω\/32Ω<\/strong><\/span>耳机，内置BTL桥接功放<\/strong><\/span>，5V供电条件下驱动4Ω负载，总谐波失真小于10%时可输出3W<\/strong><\/span>连续平均功率<\/strong><\/span>，BTL差分输出架构无需输出耦合电容、自举电容以及吸收缓冲网络，内置过热保护功能，芯片温度达到约150℃时自动关断输出，避免长时间大音量工作造成器件烧毁。<\/p>


    <\/p>

    芯片供电配置灵活，模拟电路最低工作电压1.8V<\/strong><\/span>，数字内核最低可至1.5V，耐压3V，且芯片各个功能模块均可通过软件实现独立下电；支持主、从两种工作模式<\/strong><\/span>，兼容USB 12MHz\/24MHz 时钟以及 256fs、384fs 标准音频主时钟<\/strong><\/span>，无需外部PLL锁相环，内部即可生成 8kHz～96kHz 全系列主流音频采样率，适配音乐播放、语音录音等各类业务场景。<\/p>


    <\/p>

    此外芯片模拟输入支持线路电平与麦克风信号输入<\/strong><\/span>，片载可编程增益放大器，麦克风增益最高29dB<\/strong><\/span>，支持单端、差分两种输入模式<\/strong><\/span>，差分模式能够有效抑制外部共模干扰；芯片还复用 ADC 实现直流电压检测功能，硬件可直接采集外部直流信号，可用于电池电压监测，节省额外采集器件，广泛应用于便携多媒体播放器、手持多媒体终端、掌上游戏机等各类便携音频产品。<\/p>


    <\/p>

    产品特性<\/strong><\/span><\/p>


    <\/strong><\/span><\/p>

    1）音频编解码性能<\/strong><\/span><\/p>

    1. DAC性能：信噪比91dB，48kHz、1.8V 工作条件下，THD：‑81.2dB。<\/p>

    2. ADC性能：信噪比92.7dB，48kHz、1.8V 工作条件下，THD：‑82dB。<\/p>

    3. 内置双通道耳机驱动器，16Ω负载、1.8V 供电，THD‑78dB，信噪比93dB。<\/p>

    4. 支持8kHz、11.025kHz、16kHz、22.05kHz、24kHz、32kHz、44.1kHz、48kHz、88.2kHz、96kHz采样率，全部由芯片内部根据主时钟生成。<\/p>


    <\/p>

    2）3W BTL-功率放大器<\/strong><\/span><\/p>

    ■ <\/span>功放供电电压范围：2.0V~5.5V<\/p>

    ■ <\/span>5V供电驱动4Ω负载，THD=10%时典型输出功率3W。<\/p>

    ■ <\/span>关断静态电流典型仅0.6μA，功耗低。<\/p>

    ■ <\/span>内置过热保护，过热自动关闭输出，防止器件过热损坏。<\/p>

    ■ <\/span>BTL桥接差分输出，无需扬声器输出耦合电容，简化电路。<\/p>


    <\/p>

    3）DSP 音频处理<\/strong><\/span><\/p>

    ■ <\/span>数字图形均衡器：支持高音调节，低音包含线性增益与自适应低音增强两种模式，自适应模式可避免大信号削波失真。<\/p>

    ■ <\/span>3D立体声增强功能：支持录音通路或播放通路启用，声场强度多级可调。<\/p>

    ■ <\/span>支持模拟信号与数字信号硬件混音，可直接实现线路输入功能。<\/p>

    ■ <\/span>PGA可编程增益放大器，麦克风增益档位：0dB、13dB、20dB、29dB；增益‑17.25dB~+30dB，0.75dB步进。<\/p>

    ■ <\/span>增益过零检测、DAC软静音功能，有效抑制音量切换\/开关机产生的POP爆音与拉链噪声。<\/p>

    ■ <\/span>支持CD音源去加重滤波。<\/p>

    ■ <\/span>支持差分模拟输入，抗共模干扰；支持直流检测模式，可复用ADC采集电池电压<\/p>


    <\/p>

    4）低功耗电源管理<\/strong><\/span><\/p>

    1. 1.8V供电，立体声播放功耗仅7mW，录音+回放同步工作功耗13mW。<\/p>

    2. 供电区间：模拟1.8V‑3V；数字内核1.5V‑3V；数字IO 1.8V‑3V。<\/p>

    3. 模块级软件断电：ADC、DAC、PGA、输出驱动可通过I2C寄存器单独开启\/关闭。<\/p>

    4. 可配置 ADC\/DAC 过采样率、模拟偏置电流，实现功耗与音质灵活权衡。<\/p>

    5. 内置上电复位 POR 电路，上电自动初始化寄存器。<\/p>


    <\/p>

    5）丰富数字与控制接口<\/strong><\/span><\/p>

    ■ <\/span>音频接口兼容 I2S、左对齐、DSP 模式，音频位宽支持16bit\/20bit\/24bit\/32bit。<\/p>

    ■ <\/span>可配置为主模式、从模式，适配各类MCU、DSP 主控。<\/p>

    ■ <\/span>两线 I²C 控制接口，作为从设备接受主控配置，驱动开发简单。<\/p>

    CJC8974A为高保真音乐播放、清晰语音录制，还是需要驱动小型扬声器，提供优质音频解决方案，规格书提供完整上电、下电时序指导，最大限度抑制开关机爆音，降低硬件调试难度。<\/p>


    <\/p>","keyword":null,"desc":"由工采网代理的CJC8974A是一款面向便携式音频应用的低功耗、高集成立体声音频Codec芯片，片内集成单声道BTL音频功率放大器，将录音ADC、播放DAC、耳机驱动、扬声器功放、数字音效DSP全部集成单颗5×5mmCOL 超薄QFN封装芯","tags":[],"views":0,"likes":0,"comments":0,"collects":0,"isreprint":0,"reprinturl":"","reject":null,"invite":null,"createtime":"2026-10-29 11:39:36","updatetime":"2026-10-29 11:39:36","deletetime":null,"orderby":0,"isgiveintegral":0,"istop":0,"day":"29","month":"10"}]}}